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参数资料
| 型号： | MT16JSF25664HY-80BXX |
| 元件分类： | DRAM |
| 英文描述： | 256M X 64 DDR DRAM MODULE, ZMA204 |
| 封装： | LEAD FREE, MO-268, SODIMM-204 |
| 文件页数： | 17/20页 |
| 文件大小： | 651K |
| 代理商： | MT16JSF25664HY-80BXX |
PDF: 09005aef83021ee3/Source: 09005aef83021f5a
Micron Technology, Inc., reserves the right to change products or specifications without notice.
JSF16C256x64H.fm - Rev. B 6/09 EN
6
2008 Micron Technology, Inc. All rights reserved
2GB (x64, DR) 204-Pin DDR3 SDRAM SODIMM
Functional Block Diagram
Figure 2:
Functional Block Diagram
Notes:
1. The ZQ ball on each DDR3 component is connected to an external 240
Ω ±1 percent resistor
that is tied to ground. It is used for the calibration of the component’s ODT and output
driver.
DQ
ZQ
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
U1
DM
CS# DQ
DQS#
DQ
U16
DQ
ZQ
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
U9
DQ
U18
DM
CS#
DQ
DQS#
DM
CS#
DQ
DQS#
DM
CS#
DQ
DQS#
DQ
ZQ
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
U7
DM
CS# DQ
DQS#
DQ
U20
DM
CS#
DQ
DQS#
DQ
ZQ
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
U2
DM
CS# DQ
DQS#
DQ
U15
DM
CS#
DQ
DQS#
DQ
ZQ
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
U19
DM
CS# DQ
DQS#
DQ
U8
DM
CS#
DQ
DQS#
DQ
ZQ
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
U12
DQ
U5
DM
CS#
DQ
DQS#
DM
CS#
DQ
DQS#
DQ
ZQ
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
U17
DQ
U10
DM
CS#
DQ
DQS#
DM
CS#
DQ
DQS#
DQ
ZQ
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
U11
DQ
U6
DM
CS#
DQ
DQS#
DM
CS#
DQ
DQS#
DQS0#
DQS0
DM0
S0#
S1#
DQS1#
DQS1
DM1
DQS2#
DQS2
DM2
DQS3#
DQS3
DM3
DQS4#
DQS4
DM4
DQS5#
DQS5
DM5
DQS6#
DQS6
DM6
DQS7#
DQS7
DM7
BA[2:0]
A[13:0]
RAS#
CAS#
WE#
CKE0
CKE1
ODT0
ODT1
RESET#
BA[2:0]: DDR3 SDRAM
A[13:0]: DDR3 SDRAM
RAS#: DDR3 SDRAM
CAS#: DDR3 SDRAM
WE#: DDR3 SDRAM
CKE0: Rank 0
CKE1: Rank 1
ODT0: Rank 0
ODT1: Rank 1
RST#: DDR3 SDRAM
Rank 0
CK0
CK0#
CK1
CK1#
A0
Temperature
sensor/
SPD EEPROM
A1
A2
SA0 SA1
SDA
SCL
U14
VREFCA
VSS
DDR3 SDRAM
VDD
VDDSPD
Temperature sensor/SPD EEPROM
VTT
DDR3 SDRAM
VREFDQ
Clock, control, command, and address line terminations:
Rank 0 = U1, U2, U7, U9, U11, U12, U17, U19
Rank 1 = U5, U6, U8, U10, U15, U16, U18, U20
Rank 1
VSS
ZQ
VSS
ZQ
VSS
ZQ
VSS
ZQ
VSS
ZQ
VSS
ZQ
VSS
ZQ
VSS
ZQ
VSS
EVT
EVENT#
SA2
Control, command, and address termination
CKE0, CKE1, A[13:0],
RAS#, CAS#, WE#,
ODT0, ODT1, BA[2:0],
S0#, S1#
DDR3
SDRAM
VTT
CK
CK#
DDR3
SDRAM
VDD
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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