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参数资料
| 型号： | NCP5425DBG |
| 厂商： | ON Semiconductor |
| 文件页数： | 4/22页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM VM 20TSSOP |
| 标准包装： | 75 |
| PWM 型： | 电压模式 |
| 输出数： | 2 |
| 频率 - 最大： | 938kHz |
| 占空比： | 100% |
| 电源电压： | 4.75 V ~ 13.2 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | 0°C ~ 125°C |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 包装： | 管件 |
NCP5425
ELECTRICAL CHARACTERISTICS (0 ° C < T J < 125 ° C; R OSC = 30.9 k, C COMP1,2 = 0.1 m F, 4.75 V < V CC < 13.2 V;
10.8 V < BST < 20 V, C GATE(H)1,2 = C GATE(L)1,2 = 1.0 nF; unless otherwise specified.)
Characteristic
Test Condition
Min
Typ
Max
Unit
ERROR AMPLIFIER
V FB1 Input Bias Current
V FB2 , V REF2 Input Bias Current
Common Mode Input Voltage Range
COMP1(2) Source Current
COMP1(2) Sink Current
Reference Voltage
COMP1 Max Voltage
COMP2 Max Voltage, Mode Floating
COMP2 Max Voltage, Mode = 0
COMP1(2) Min Voltage
Open Loop Gain
Unity Gain Bandwidth
PSRR @ 1.0 kHz
Transconductance
Output Impedance
V FB1 = 0 V
V FB2 , V REF2 = 0.8 V
?
COMP1(2) = 1.2 V to 2.5 V; V FB1(2) = 0.6 V
COMP1(2) = 1.2 V; V FB1(2) = 1.0 V
COMP1 = V FB1
V FB1(2) = 0.6 V
V FB1(2) = 0.6 V
V FB1(2) = 0.6 V
V FB1(2) = 1.2 V
?
?
?
?
0.3
15
15
0.792
?
3.0
?
?
?
?
?
?
?
0.1
0.1
?
30
30
0.800
2.0
3.1
2.0
0.10
95
40
70
32
2.5
1.0
1.0
1.0
60
60
0.808
2.1
?
2.1
0.20
?
?
?
?
?
m A
m A
V
m A
m A
V
V
V
dB
kHz
dB
mmho
M W
GATE(H) AND GATE(L)
High Voltage (AC)
V CC ? GATE(L)1,2
?
0
0.5
V
BST ? GATE(H)1,2 (Note 2)
Low Voltage (AC)
Rise Time
GATE(L)1,2 or GATE(H)1,2 (Note 2)
1.0 V < GATE(L)1,2 < V CC ? 1.0 V
?
?
0
25
0.5
80
V
ns
1.0 V < GATE(H)1,2 < BST ? 1.0 V
Fall Time
V CC ? 1.0 > GATE(L)1,2 > 1.0 V
?
25
80
ns
BST ? 1.0 > GATE(H)1,2 > 1.0 V
GATE(H) to GATE(L) Delay
GATE(H)1,2 < 2.0 V
20
40
80
ns
GATE(L)1,2 > 2.0 V
GATE(L) to GATE(H) Delay
GATE(L)1,2 < 2.0 V
20
40
80
ns
GATE(H)1,2 > 2.0 V
GATE(H)1(2) and GATE(L)1(2) Pull?Down
Resistance to GND (Note 2)
50
125
280
k W
PWM COMPARATOR
Propagation Delay
COMP1(2) = 1.0 V
?
200
300
ns
V FB1(2) = 0 to 1.2 V (Note 2)
PWM Comparator Offset
V FB1(2) = 0 V; Increase COMP1(2) until
0.20
0.30
0.45
V
GATE(H)1(2) starts switching
Artificial Ramp
Minimum Pulse Width
Duty Cycle = 50%
(Note 2)
55
?
95
80
150
130
mV
ns
2. Guaranteed by design, not 100% tested in production.
http://onsemi.com
4
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