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参数资料
| 型号： | OR3T80-4B600 |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 484 CLBS, 58000 GATES, PBGA600 |
| 封装： | BGA-600 |
| 文件页数： | 6/210页 |
| 文件大小： | 2138K |
| 代理商： | OR3T80-4B600 |
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Preliminary Data Sheet, Rev. 1
September 1998
ORCA Series 3 FPGAs
Lucent Technologies Inc.
103
Timing Characteristics (continued)
Table 42. Ripple Mode PFU Timing Characteristics
OR3Cxx Commercial: VDD = 5.0 V ± 5%, 0 °C
< TA < 70 °C; Industrial: VDD = 5.0 V ± 10%, –40 °C < TA < +85 °C.
OR3Txxx Commercial: VDD = 3.0 V to 3.6 V, 0 °C
< TA < 70 °C; Industrial: VDD = 3.0 V to 3.6 V, –40 °C < TA < +85 °C.
Parameter
(TJ = +85 °C, VDD = min)
Symbol
Speed
Unit
-4
-5
-6
Min
Max
Min
Max
Min
Max
Full Ripple Setup Times (byte wide):
Operands to Clock (Kz[1:0] to CLK)
Bitwise Operands to Clock (Kz[1:0] to CLK at F[z])
Fast Carry-in to Clock (FCIN to CLK)
Carry-in to Clock (CIN to CLK)
Add/Subtract to Clock (ASWE to CLK)
Operands to Clock (Kz[1:0] to CLK at REGCOUT)
Fast Carry-in to Clock (FCIN to CLK at REGCOUT)
Carry-in to Clock (CIN to CLK at REGCOUT)
Add/Subtract to Clock (ASWE to CLK at REGCOUT)
RIP_SET*
FRIP_SET*
FCIN_SET*
CIN_SET*
AS_SET*
RIPRC_SET
FCINRC_SET
CINRC_SET
ASRC_SET
7.12
1.99
5.76
6.84
10.35
5.23
2.29
3.09
8.14
—
5.34
1.47
4.28
4.94
7.24
4.03
1.76
2.36
5.73
—
3.97
1.12
3.16
3.60
5.06
3.00
1.33
1.72
4.16
—
ns
Full Ripple Hold Times (TJ = all, VDD = all):
Fast Carry-in from Clock (FCIN from CLK at REGCOUT)
All Others
FCINRC_HLD
GENERIC_HLD
0.00
—
0.00
—
0.00
—
ns
Half Ripple Setup Times (nibble wide):
Operands to Clock (Kz[1:0] to CLK)
Bitwise Operands to Clock (Kz[1:0] to CLK at F[z])
Fast Carry-in to Clock (FCIN to CLK)
Carry-in to Clock (CIN to CLK)
Add/Subtract to Clock (ASWE to CLK)
Operands to Clock (Kz[1:0] to CLK at REGCOUT)
Fast Carry-in to Clock (FCIN to CLK at REGCOUT)
Carry-in to Clock (CIN to CLK at REGCOUT)
Add/Subtract to Clock (ASWE to CLK at REGCOUT)
HRIP_SET*
HFRIP_SET*
HFCIN_SET*
HCIN_SET*
HAS_SET*
HRIPRC_SET
HFCINRC_SET
HCINRC_SET
HASRC_SET
5.24
1.99
3.49
4.74
8.82
5.23
2.29
3.09
8.14
—
3.81
1.47
2.57
3.42
6.18
4.03
1.76
2.36
5.73
—
2.82
1.12
1.87
2.43
4.25
3.00
1.33
1.72
4.16
—
ns
Half Ripple Hold Times (TJ = all, VDD = all):
Fast Carry-in from Clock (HFCIN from CLK at REGCOUT)
All Others
HFCINRC_HLD
GENERIC_HLD
0.00
—
0.00
—
0.00
—
ns
* ORCA Foundry may, in rare routing instances, report a slightly larger value for this parameter; in which case, ORCA Foundry results take
precedence.
Notes:
Shaded values are advance information and are valid for OR3Txxx devices only.
The table shows worst-case delay for the ripple chain. ORCA Foundry reports the delay for individual paths within the ripple chain that will be
less than or equal to those listed above.
相关PDF资料 |
PDF描述 |
|---|---|
| OR3T80-5B432 | FPGA, 484 CLBS, 58000 GATES, PBGA432 |
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| OR3T80-6B600 | FPGA, 484 CLBS, 58000 GATES, PBGA600 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| OR3T80-4BC600I | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Field Programmable Gate Array (FPGA) |
| OR3T80-4PS208I | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Field Programmable Gate Array (FPGA) |
| OR3T80-4PS240I | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Field Programmable Gate Array (FPGA) |
| OR3T80-5BA352 | 制造商:AGERE 制造商全称:AGERE 功能描述:3C and 3T Field-Programmable Gate Arrays |
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