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参数资料
| 型号： | ORSO42G5-1BMN484C |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 112/153页 |
| 文件大小： | 0K |
| 描述： | IC TRANCEIVERS FPSC 680FPGAM |
| 产品变化通告： | Product Discontinuation 01/Aug/2011 |
| 标准包装： | 60 |
| 系列： | * |
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Lattice Semiconductor
ORCA ORSO42G5 and ORSO82G5 Data Sheet
61
Table 11. TX FPGA/Core Interface Signaling – ORSO42G5
Signal Description for TX Path (FPGA to SERDES Core) – ORSO82G5
Signals are divided across 8 channels with 40 signals per channel. TXDxx[39:0] is the set of 40 signals for a
channel xx.
The data signals multiplexing scheme is similar to the one used for the RXD signals. However, the status signals
multiplexing is different. Please refer to Table 12 for the detailed description of the TXD multiplexing scheme.
For all channels the TXDxx[39:33] signals are not used.
Table 12 summarizes the signals at the FPGA/Core interface in the transmit direction.
TXDAC
SONET Mode
OPC2 A2 Mode
[39:33]
—
32
DINAC_FP
—
[31:21]
DINAC[31:21]
—
20
DINAC[20]
OPC2_A2_CELLVALID
[19:0]
DINAC[19:0]
OPC2_A2[39:20]
TXDAD
SONET Mode
OPC2 A2 Mode
[39:33]
—
32
DINAD_FP
—
[31:21]
DINAD[31:21]
—
20
DINAD[20]
—
[19:0]
DINAD[19:0]
OPC2_A2[19:0]
Table 12. TX FPGA/Core Interface Signaling – ORSO82G5
TXDAA
SONET Mode
OPC2 A1 Mode
OPC8 Mode
[39:33]
—
32
DINAA_FP
—
[31:21]
DINAA[31:21]
—
20
DINAA[20]
OPC2_A1_CELLVALID
—
[19:0]
DINAA[19:0]
OPC2_A1[39:20]
OPC8[159:140]
TXDAB
SONET Mode
OPC2 A1 Mode
OPC8 Mode
[39:33]
—
32
DINAB_FP
—
[31:20]
DINAB[31:20]
—
[19:0]
DINAB[19:0]]
OPC2_A1[19:0]]
OPC8[139:120]]
TXDAC
SONET Mode
OPC2 A2 Mode
OPC8 Mode
[39:33]
—
32
DINAC_FP
—
[31:21]
DINAC[31:21]
—
20
DINAC[20]
OPC2_A2_CELLVALID
—
[19:0]
DINAC[19:0]
OPC2_A2[39:20]
OPC8[119:100]
TXDAD
SONET Mode
OPC2 A2 Mode
OPC8 Mode
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PDF描述 |
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参数描述 |
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| ORSO42G5-2BM484C | 功能描述:FPGA - 现场可编程门阵列 10368 LUT 204 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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