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参数资料
| 型号： | P0304 |
| 厂商： | Terasic Technologies Inc |
| 文件页数： | 58/93页 |
| 文件大小： | 0K |
| 描述： | DE2-70 CALL FOR ACADEMIC PRICING |
| 标准包装： | 1 |
| 类型： | FPGA |
| 适用于相关产品： | Cyclone II 2C70 |
| 所含物品： | DE2-70 板，电源，线缆，塑料盖和软件 |
| 配用： | P0033-ND - BOARD ADAPTER HSMC TO GPIO P0006-ND - BOARD ADAPTER THDB-SUM P0001-ND - MODULE DIGITAL CAMERA 5MP (D5M) P0307-ND - KIT DEV 4.3" LCD TOUCH PANEL |
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| 其它名称： | DE2-70 |
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DE2-70 User Manual
5.14 Using USB Host and Device
The DE2-70 board provides both USB host and device interfaces using the Philips ISP1362
single-chip USB controller. The host and device controllers are compliant with the Universal Serial
Bus Specification Rev. 2.0, supporting data transfer at full-speed (12 Mbit/s) and low-speed (1.5
Mbit/s). Figure 5.20 shows the schematic diagram of the USB circuitry; the pin assignments for the
associated interface are listed in Table 5.17.
Detailed information for using the ISP1362 device is available in its datasheet and programming
guide; both documents can be found on the manufacturer ’s web site, or in the Datasheet/USB folder
on the DE2-70 System CD-ROM . The most challenging part of a USB application is in the design
of the software driver needed. Two complete examples of USB drivers, for both host and device
applications, can be found in Sections 6.4 and 6.5. These demonstrations provide examples of
software drivers for the Nios II processor.
OTG_D[0..15]
U_VCC33
H_VCC5
D85
H_VCC5
D86
U14
U_VCC5
BAT54S
BAT54S
J13
L10
BEAD
H_VCC5
1
U_VCC33
OTG_A1
OTG_A0
OTG_D15
OTG_D14
OTG_D13
OTG_D12
OTG_D11
OTG_D10
OTG_D9
OTG_D8
OTG_D7
OTG_D6
OTG_D5
OTG_D4
OTG_D3
OTG_D2
OTG_D1
OTG_D0
R111 4.7K
OTG_CS_n
OTG_WE_n
OTG_OE_n
OTG_INT1
OTG_INT0
OTG_RESET_n
62
61
18
17
16
15
13
12
11
10
8
7
6
5
3
2
64
63
21
22
20
31
30
32
A1
A0
D15
D14
D13
D12
D11
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
CS
WR
RD
INT2
INT1
RESET
H_SUSPEND/H_SUSWKUP
H_SUSPEND/D_SUSWKUP
VDD_5V
H_OC2
H_PSW2
H_DM2
H_DP2
H_OC1
H_PSW1
OTG_DM1
OTG_DP1
ISP1362
ID
OTGMODE
VBUS
CP_CAP2
CP_CAP1
GL
TEST2
TEST1
TEST0
33
34
56
41
36
46
47
42
35
49
50
48
45
55
54
53
39
60
59
23
R118
R119
C50
R120
R121
R122
R123
U_VCC5
4.7K
4.7K
0.1u
330
10K
10K
100K
U_VCC33
GOOD
LEDB
U_VCC33
R112
R113
R116
R117
U_VCC33
22
22
22
22
R114
15K
O_VCC5
C48
47p
D87
R115
15K
O_VCC5
C49
47p
D88
2
3
4
BC66 0.1u
USB A-TYPE
OTG_DREQ1
OTG_DACK1_n
OTG_DREQ0
OTG_DACK0_n
25
29
24
28
DREQ2
DACK2
DREQ1
DACK1
CLKOUT
X1
X2
38
43
44
OTG_FSPEED
OTG_LSPEED
R124
R125
1.5K
1.5K
BAT54S
BAT54S
3
2
J14
D-
D+
L11
BEAD
O_VCC5
C52
C53
1
4 VBUS
GND
USB B-TYPE
47p
47p
BC68 0.1u
12MHZ
R126
22
C54
47p
Figure 5.20. USB (ISP1362) host and device schematic.
Signal Name
OTG_A[0]
OTG_A[1]
OTG_D[0]
OTG_D[1]
OTG_D[2]
OTG_D[3]
FPGA Pin No.
PIN_E9
PIN_D8
PIN_H10
PIN_G9
PIN_G11
PIN_F11
55
Description
ISP1362 Address[0]
ISP1362 Address[1]
ISP1362 Data[0]
ISP1362 Data[1]
ISP1362 Data[2]
ISP1362 Data[3]
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