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参数资料
| 型号： | PEF3452 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Line Interface Unit for DS3, STS 1 and E3 |
| 中文描述： | 线路接口单元的DS3中，STS 1和E3 |
| 文件页数： | 23/71页 |
| 文件大小： | 1372K |
| 代理商： | PEF3452 |
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PEF 3452
TE3-LIU V1.3
Pin Descriptions
Preliminary Data Sheet
13
2001-12-05
PRELIMINARY
43
JATT
I
+
PD
J
itter Attenuation Enable
This signal has to be stable during reset
and may notchange afterwards. It must not
be connected to a
μ
P bus.
0
=
no jitter attenuation (default if left open)
1
=
jitter attenuation in transmit direction
Loss of Signal Indication
0
=
correct signal
1
=
loss of signal
LOS is synchronized on RCLK. During
LOS, a clock signal is generated internally
and driven on RCLK.
22
LOS
O
1)
If RL
=
LL
=
1, the device is set into power down mode.
Table 2
Pin No.
Control Pin Functions
(cont’d)
Symbol
Input
(
I
)
Output
(
O
)
Supply
(
S
)
Function
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