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参数资料
| 型号： | PEF3452 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Line Interface Unit for DS3, STS 1 and E3 |
| 中文描述： | 线路接口单元的DS3中，STS 1和E3 |
| 文件页数： | 41/71页 |
| 文件大小： | 1372K |
| 代理商： | PEF3452 |
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PEF 3452
TE3-LIU V1.3
Interface Description
Preliminary Data Sheet
31
2001-12-05
PRELIMINARY
4.2.3
J
itter Attenuation
Jitter is reduced in transmit direction, if the jitter attenuator is activated (JATT
=
1). The
JATT control signal enables/disables the jitter attenuation PLL and activates/bypasses
the buffer.
The jitter attenuator consists of a buffer and a PLL. The jitter attenuation PLL delivers a
"
jitter free
"
clock (nominal frequency divided by 3, see
Table 13
) to the transmit PLL
which generates the buffer read clock. The jitter attenuation PLL uses a pullable crystal
and supports a tuning range of
±
150 ppm.
The jitter attenuator uses a 64-bit dual rail buffer and fulfills the requirements of GR-499-
CORE and GR-253-CORE as shown in
Figure 15
. This covers the requirements of ITU-
T G.751, G.752 and G.755 as well.
To avoid the need for a high frequency crystal, the reference clock for the jitter
attenuation PLL is only one third of the nominal frequency. A detailed block diagram of
the transmit clocking is given in
Figure 14
.
Further requirements for the external crystal are found in
Table 21
on
page 45
.
Table 13
Operation mode
J
itter Attenuation PLL Operation Fre
q
uencies
J
itter Attenuation
PLL Input
Fre
q
uency
44.736 MHz
51.840 MHz
34.368 MHz
J
itter Attenuation
PLL Output
Fre
q
uency
14.912 MHz
17.280 MHz
11.456 MHz
Crystal Fre
q
uency
DS3
STS-1
E3
14.912 MHz
17.280 MHz
11.456 MHz
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PDF描述 |
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