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参数资料
| 型号： | PEF3452 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Line Interface Unit for DS3, STS 1 and E3 |
| 中文描述： | 线路接口单元的DS3中，STS 1和E3 |
| 文件页数： | 28/71页 |
| 文件大小： | 1372K |
| 代理商： | PEF3452 |
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PEF 3452
TE3-LIU V1.3
Functional Description
Preliminary Data Sheet
18
2001-12-05
PRELIMINARY
3.3
Functional
B
locks
3.3.1
Hardware Control Unit
All hardware control signals except DS3/E3, DS3/STS-1 and JATT are gated by CS. All
other control signals are gated by CS to allow an easy connection to a microprocessor
(
μ
P) data bus. DS3/E3, DS3/STS-1 and JATT may not be connected to a data bus. If
direct hardware control without
μ
P is intended, CS has to be connected to V
SS
.
After reset all control input values are cleared. The default control values (driven by
internal pullups) are activated after CS
=
low is applied for the first time after reset.
Table 5
Device Function
Hardware Control Functions
Control Signal
Selection of E3 or DS3/STS-1 mode
1)
DS3/E3
0
=
E3
1
=
DS3 or STS-1
2)
DS3/STS-1
0
=
STS-1
1
=
DS3
2)
This pin is ignored, if E3 mode is selected
by DS3/E3
=
0
DR/SR
0
=
single rail data on RDOP and XDIP
1
=
dual rail data on RDOP/RDON and
XDIP/XDIN
2)
RPE
0
=
data change on negative edge
1
=
data change on positive edge
2)
XPE
0
=
data change on negative edge
1
=
data change on positive edge
2)
LCODE
0
=
AMI
1
=
HDB3 (E3)
2)
1
=
B3ZS (DS3/STS-1)
2)
Selection of DS3 or STS-1 mode
1)
Dual rail select
Receive clock edge selection
Transmit clock edge selection
Selection of line coding
Send AIS (all-ones alarm indication signal) XAIS
0
=
no insertion
1
=
AIS insertion
2)
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