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参数资料
| 型号： | PIC12LF1840-I/MF |
| 厂商： | Microchip Technology |
| 文件页数： | 106/122页 |
| 文件大小： | 0K |
| 描述： | MCU 7KB FLASH 256B RAM 8-DFN |
| 产品培训模块： | 8-bit PIC® Microcontroller Portfolio |
| 标准包装： | 120 |
| 系列： | PIC® XLP™ 12F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 32MHz |
| 连通性： | I²C，LIN，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 5 |
| 程序存储器容量： | 7KB（4K x 14） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 256 x 8 |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 4x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 8-VDFN 裸露焊盘 |
| 包装： | 管件 |
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PIC12(L)F1840
DS41441B-page 84
Preliminary
2011 Microchip Technology Inc.
8.5.2
PIE1 REGISTER
The PIE1 register contains the interrupt enable bits, as
shown in Register 8-2.
Note:
Bit PEIE of the INTCON register must be
set to enable any peripheral interrupt.
REGISTER 8-2:
PIE1: PERIPHERAL INTERRUPT ENABLE REGISTER 1
R/W-0/0
TMR1GIE
ADIE
RCIE
TXIE
SSP1IE
CCP1IE
TMR2IE
TMR1IE
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
u = Bit is unchanged
x = Bit is unknown
-n/n = Value at POR and BOR/Value at all other Resets
‘1’ = Bit is set
‘0’ = Bit is cleared
bit 7
TMR1GIE:
Timer1 Gate Interrupt Enable bit
1
= Enables the Timer1 Gate Acquisition interrupt
0
= Disables the Timer1 Gate Acquisition interrupt
bit 6
ADIE:
A/D Converter (ADC) Interrupt Enable bit
1
= Enables the ADC interrupt
0
= Disables the ADC interrupt
bit 5
RCIE:
USART Receive Interrupt Enable bit
1
= Enables the USART receive interrupt
0
= Disables the USART receive interrupt
bit 4
TXIE:
USART Transmit Interrupt Enable bit
1
= Enables the USART transmit interrupt
0
= Disables the USART transmit interrupt
bit 3
SSP1IE:
Synchronous Serial Port (MSSP) Interrupt Enable bit
1
= Enables the MSSP interrupt
0
= Disables the MSSP interrupt
bit 2
CCP1IE:
CCP1 Interrupt Enable bit
1
= Enables the CCP1 interrupt
0
= Disables the CCP1 interrupt
bit 1
TMR2IE:
TMR2 to PR2 Match Interrupt Enable bit
1
= Enables the Timer2 to PR2 match interrupt
0
= Disables the Timer2 to PR2 match interrupt
bit 0
TMR1IE:
Timer1 Overflow Interrupt Enable bit
1
= Enables the Timer1 overflow interrupt
0
= Disables the Timer1 overflow interrupt
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