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参数资料
| 型号： | PIC14000-04I/SO |
| 厂商： | Microchip Technology |
| 文件页数： | 46/153页 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 4KX14 A/D 28SOIC |
| 产品培训模块： | Asynchronous Stimulus 8-bit PIC® Microcontroller Portfolio |
| 标准包装： | 27 |
| 系列： | PIC® 14 |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 4MHz |
| 连通性： | I²C |
| 外围设备： | POR，温度传感器，WDT |
| 输入/输出数： | 20 |
| 程序存储器容量： | 7KB（4K x 14） |
| 程序存储器类型： | OTP |
| RAM 容量： | 192 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 6 V |
| 数据转换器： | 斜率 A/D |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 包装： | 管件 |
| 配用： | ISPICR1-ND - ADAPTER IN-CIRCUIT PROGRAMMING 309-1073-ND - ADAPTER 28-SOIC TO 28-SOIC 309-1024-ND - ADAPTER 28-SOIC TO 28-DIP 309-1023-ND - ADAPTER 28-SOIC TO 28-DIP |
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PIC14000
DS40122B-page 14
Preliminary
1996 Microchip Technology Inc.
TABLE 4-2:
CALIBRATION CONSTANT
ADDRESSES
4.2
Data Memory Organization
The data memory (Figure 4-2) is partitioned into two
banks which contain the general purpose registers and
the special function registers. Bank 0 is selected when
the RP0 bit in the STATUS register is cleared. Bank 1
is selected when the RP0 bit in the STATUS register is
set. Each bank extends up to 7Fh (128 bytes). The rst
32 locations of each bank are reserved for the Special
Function
Registers.
Several
Special
Function
Registers are mapped in both Bank 0 and Bank 1. The
general purpose registers, implemented as static RAM,
are located from address 20h through 7Fh, and A0
through FF.
Address
Data
0FC0h
K
REF , exponent
0FC1h
K
REF , mantissa high byte
0FC2h
K
REF , mantissa middle byte
0FC3h
K
REF , mantissa low byte
0FC4h
K
BG , exponent
0FC5h
K
BG , mantissa high byte
0FC6h
K
BG , mantissa middle byte
0FC7h
K
BG , mantissa low byte
0FC8h
V
THERM , exponent
0FC9h
V
THERM , mantissa high byte
0FCAh
V
THERM , mantissa middle byte
0FCBh
V
THERM , mantissa low byte
0FCCh
K
TC , exponent
0FCDh
K
TC , mantissa high byte
0FCEh
K
TC , mantissa middle byte
0FCFh
K
TC , mantissa low byte
0FD0h
F
OSC, unsigned byte
0FD1h
reserved
0FD2h
T
WDT, unsigned byte
0FD3h -
0FF8h
reserved
0FF9h-Fh
calibration space checksums
4.2.1
GENERAL PURPOSE REGISTER FILE
The register le is accessed either directly, or indirectly
through the le select register FSR (Section 4.4).
FIGURE 4-2:
REGISTER FILE MAP
File Address
* Not a physical register.
Shaded areas are unimplemented memory locations,
read as ‘0’s.
00h
Indirect add.(*)
Indirect addr.(*)
80h
01h
TMR0
OPTION
81h
02h
PCL
82h
03h
STATUS
83h
04h
FSR
84h
05h
PORTA
TRISA
85h
06h
RESERVED
86h
07h
PORTC
TRISC
87h
08h
PORTD
TRISD
88h
09h
89h
0Ah
PCLATH
8Ah
0Bh
INTCON
8Bh
0Ch
PIR1
PIE1
8Ch
0Dh
8Dh
0Eh
ADTMRL
PCON
8Eh
0Fh
ADTMRH
SLPCON
8Fh
10h
90h
11h
91h
12h
92h
13h
I2CBUF
I2CADD
93h
14h
I2CCON
I2CSTAT
94h
15h
ADCAPL
95h
16h
ADCAPH
96h
17h
97h
18h
98h
19h
99h
1Ah
9Ah
1Bh
PREFA
9Bh
1Ch
PREFB
9Ch
1Dh
CMCON
9Dh
1Eh
MISC
9Eh
1Fh
ADCON0
ADCON1
9Fh
20h
General
Purpose
Register
(96 Bytes)
General
Purpose
Register
(96 Bytes)
A0h
7F
FF
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PDF描述 |
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