参数资料
| 型号： | PIC16C765-I/L |
| 厂商： | Microchip Technology |
| 文件页数： | 161/165页 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 8KX14 USB 44PLCC |
| 产品培训模块： | Asynchronous Stimulus 8-bit PIC® Microcontroller Portfolio |
| 标准包装： | 27 |
| 系列： | PIC® 16C |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 24MHz |
| 连通性： | SCI，UART/USART，USB |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 33 |
| 程序存储器容量： | 14KB（8K x 14） |
| 程序存储器类型： | OTP |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.35 V ~ 5.25 V |
| 数据转换器： | A/D 8x8b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-LCC（J 形引线） |
| 包装： | 管件 |
| 产品目录页面： | 636 (CN2011-ZH PDF) |
| 配用： | AC164309-ND - MODULE SKT FOR PM3 44PLCC ISPICR1-ND - ADAPTER IN-CIRCUIT PROGRAMMING 444-1001-ND - DEMO BOARD FOR PICMICRO MCU |
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2000 Microchip Technology Inc.
Preliminary
DS41124C-page 95
PIC16C745/765
12.1
A/D Acquisition Requirements
For the A/D converter to meet its specified accuracy,
the charge holding capacitor (CHOLD) must be allowed
to fully charge to the input channel voltage level. The
analog input model is shown in Figure 12-2. The
source impedance (RS) and the internal sampling
switch (RSS) impedance directly affect the time
required to charge the capacitor CHOLD. The sampling
switch (RSS) impedance varies over the device voltage
offset voltage at the analog input (due to pin leakage
current).
The maximum recommended impedance for ana-
log sources is 10 k
. After the analog input channel is
selected (changed), the acquisition must pass before
the conversion can be started.
To
calculate
the
minimum
acquisition
time,
Equation 12-1 may be used. This equation assumes
that 1/2 LSb error is used (512 steps for the A/D). The
1/2 LSb error is the maximum error allowed for the A/D
to meet its specified resolution.
To calculate the minimum acquisition time, TACQ, see
the PICmicro Mid-Range MCU Family Reference
Manual (DS33023). In general, however, given a max
of 10k
and a worst case temperature of 100°C, TACQ
will be no more than 16sec.
FIGURE 12-2: ANALOG INPUT MODEL
EQUATION 12-1:
ACQUISITION TIME
CPIN
VA
Rs
ANx
5 pF
VDD
VT = 0.6V
I leakage
RIC
≤ 1k
Sampling
Switch
SS RSS
CHOLD
= DAC capacitance
VSS
6V
Sampling Switch
5V
4V
3V
2V
5678 9 10 11
(k
)
VDD
= 51.2 pF
± 500 nA
Legend
CPIN
VT
I leakage
RIC
SS
CHOLD
= input capacitance
= threshold voltage
= leakage current at the pin due to
= interconnect resistance
= sampling switch
= sample/hold capacitance (from DAC)
various junctions
TACQ
=
Amplifier Settling Time +
Hold Capacitor Charging Time +
Temperature Coefficient
TAMP + TC + TCOFF
TAMP = 5
S
TC = - (51.2pF)(1k
+ RSS + RS) In(1/511)
TCOFF = (Temp -25
°C)(0.05S/°C)
745cov.book Page 95 Wednesday, August 2, 2000 8:24 AM
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