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参数资料
型号： PIC16C765-I/L
厂商： Microchip Technology
文件页数： 75/165页
文件大小： 0K
描述： IC MCU OTP 8KX14 USB 44PLCC
产品培训模块： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
标准包装： 27
系列： PIC® 16C
核心处理器： PIC
芯体尺寸： 8-位
速度： 24MHz
连通性： SCI，UART/USART，USB
外围设备： 欠压检测/复位，POR，PWM，WDT
输入/输出数： 33
程序存储器容量： 14KB（8K x 14）
程序存储器类型： OTP
RAM 容量： 256 x 8
电压 - 电源 (Vcc/Vdd)： 4.35 V ~ 5.25 V
数据转换器： A/D 8x8b
振荡器型： 外部
工作温度： -40°C ~ 85°C
封装/外壳： 44-LCC（J 形引线）
包装： 管件
产品目录页面： 636 (CN2011-ZH PDF)
配用： AC164309-ND - MODULE SKT FOR PM3 44PLCC
ISPICR1-ND - ADAPTER IN-CIRCUIT PROGRAMMING
444-1001-ND - DEMO BOARD FOR PICMICRO MCU
2000 Microchip Technology Inc.
Preliminary
DS41124C-page 17
PIC16C745/765
4.2.2
SPECIAL FUNCTION REGISTERS
The Special Function Registers are registers used by
the CPU and Peripheral Modules for controlling the
desired operation of the device. These registers are
implemented as static RAM.
The Special Function Registers can be classified into
two sets (core and peripheral). Those registers associ-
ated with the “core” functions are described in this sec-
tion, and those related to the operation of the peripheral
features are described in the section of that peripheral
feature.
TABLE 4-1:
SPECIAL FUNCTION REGISTER SUMMARY
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on:
POR,
BOR
Value on all
other resets
(2)
Bank 0
00h
INDF(3)
Addressing this location uses contents of FSR to address data memory (not a physical register)
0000 0000
01h
TMR0
Timer0 module’s register
xxxx xxxx
uuuu uuuu
02h
PCL(3)
Program Counter's (PC) Least Significant Byte
0000 0000
03h
STATUS(3)
IRP(2)
RP1(2)
RP0
TO
PD
ZDC
C
0001 1xxx
000q quuu
04h
FSR(3)
Indirect data memory address pointer
xxxx xxxx
uuuu uuuu
05h
PORTA
—
PORTA Data Latch when written: PORTA pins when read
--0x 0000
--0u 0000
06h
PORTB
PORTB Data Latch when written: PORTB pins when read
xxxx xxxx
uuuu uuuu
07h
PORTC
RC7
RC6
—
RC2
RC1
RC0
xx-- -xxx
uu-- -uuu
08h
PORTD
(4)
PORTD Data Latch when written: PORTD pins when read
xxxx xxxx
uuuu uuuu
09h
PORTE(4)
—
RE2
RE1
RE0
---- -xxx
---- -uuu
0Ah
PCLATH(1,3)
—
Write Buffer for the upper 5 bits of the Program Counter
---0 0000
0Bh
INTCON
(3)
GIE
PEIE
T0IE
INTE
RBIE
T0IF
INTF
RBIF
0000 000x
0000 000u
0Ch
PIR1
PSPIF(4)
ADIF
RCIF
TXIF
USBIF
CCP1IF
TMR2IF
TMR1IF
0000 0000
0Dh
PIR2
—
–
—
CCP2IF
---- ---0
0Eh
TMR1L
Holding register for the Least Significant Byte of the 16-bit TMR1 register
xxxx xxxx
uuuu uuuu
0Fh
TMR1H
Holding register for the Most Significant Byte of the 16-bit TMR1 register
xxxx xxxx
uuuu uuuu
10h
T1CON
—
T1CKPS1
T1CKPS0
T1OSCEN
T1SYNC
TMR1CS
TMR1ON
--00 0000
--uu uuuu
11h
TMR2
Timer2 module’s register
0000 0000
12h
T2CON
—
TOUTPS3
TOUTPS2
TOUTPS1
TOUTPS0
TMR2ON
T2CKPS1
T2CKPS0
-000 0000
13h
—
Unimplemented
—
14h
—
Unimplemented
—
15h
CCPR1L
Capture/Compare/PWM Register1 (LSB)
xxxx xxxx
uuuu uuuu
16h
CCPR1H
Capture/Compare/PWM Register1 (MSB)
xxxx xxxx
uuuu uuuu
17h
CCP1CON
—
DC1B1
DC1B0
CCP1M3
CCP1M2
CCP1M1
CCP1M0
--00 0000
18h
RCSTA
SPEN
RX9
SREN
CREN
—
FERR
OERR
RX9D
0000 -00x
19h
TXREG
USART Transmit Data Register
0000 0000
1Ah
RCREG
USART Receive Data Register
0000 0000
1Bh
CCPR2L
Capture/Compare/PWM Register2 (LSB)
xxxx xxxx
uuuu uuuu
1Ch
CCPR2H
Capture/Compare/PWM Register2 (MSB)
xxxx xxxx
uuuu uuuu
1Dh
CCP2CON
—
DC2B1
CCP2M3
CCP2M2
CCP2M1
CCP2M0
--00 0000
1Eh
ADRES
A/D Result Register
xxxx xxxx
uuuu uuuu
1Fh
ADCON0
ADCS1
ADCS0
CHS2
CHS1
CHS0
GO/DONE
—
ADON
0000 00-0
Legend: x = unknown, u = unchanged, q = value depends on condition, - = unimplemented read as ’0’.
Shaded locations are unimplemented, read as ‘0’.
Note 1:
The upper byte of the program counter is not directly accessible. PCLATH is a holding register for the PC<12:8> whose contents
are transferred to the upper byte of the program counter.
2:
Other (non power-up) RESETS include external RESET through MCLR and Watchdog Timer Reset.
3:
These registers can be addressed from any bank.
4:
The Parallel Slave Port (PORTD and PORTE) is not implemented on the PIC16C745, always maintain these bits clear.
745cov.book Page 17 Wednesday, August 2, 2000 8:24 AM
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