参数资料
型号: PIC16LC926-I/PT
元件分类: 微控制器/微处理器
英文描述: 8-BIT, OTPROM, 10 MHz, RISC MICROCONTROLLER, PQFP64
封装: 10 X 10 MM, 1 MM HEIGHT, PLASTIC, TQFP-64
文件页数: 126/183页
文件大小: 3233K
代理商: PIC16LC926-I/PT
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2001 Microchip Technology Inc.
Preliminary
DS39544A-page 45
PIC16C925/926
5.3.1
SWITCHING PRESCALER
ASSIGNMENT
The prescaler assignment is fully under software con-
trol, i.e., it can be changed “on the fly” during program
execution.
EXAMPLE 5-1:
CHANGING PRESCALER (TIMER0
→WDT)
To change prescaler from the WDT to the Timer0 mod-
ule use the precaution shown in Example 5-2.
EXAMPLE 5-2:
CHANGING PRESCALER (WDT
→TIMER0)
TABLE 5-1:
REGISTERS ASSOCIATED WITH TIMER0
Note:
To avoid an unintended device RESET,
the following instruction sequence (shown
in Example 5-1) must be executed when
changing the prescaler assignment from
Timer0 to the WDT. This precaution must
be followed even if the WDT is disabled.
1)
BSF
STATUS, RP0
;Select Bank1
Lines 2 and 3 do NOT have to
be included if the final desired
prescale value is other than 1:1.
If 1:1 is final desired value, then
a temporary prescale value is
set in lines 2 and 3 and the final
prescale value will be set in lines
10 and 11.
2)
MOVLW
b’xx0x0xxx’
;Select clock source and prescale value of
3)
MOVWF
OPTION_REG
;other than 1:1
4)
BCF
STATUS, RP0
;Select Bank0
5)
CLRF
TMR0
;Clear TMR0 and prescaler
6)
BSF
STATUS, RP1
;Select Bank1
7)
MOVLW
b’xxxx1xxx’
;Select WDT, do not change prescale value
8)
MOVWF
OPTION_REG
;
9)
CLRWDT
;Clears WDT and prescaler
10) MOVLW
b’xxxx1xxx’
;Select new prescale value and WDT
11) MOVWF
OPTION_REG
;
12) BCF
STATUS, RP0
;Select Bank0
CLRWDT
;Clear WDT and precaler
BSF
STATUS, RP0
;Select Bank1
MOVLW
b’xxxx0xxx’
;Select TMR0,
;new prescale value and
MOVWF
OPTION_REG
;clock source
BCF
STATUS, RP0
;Select Bank0
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
Power-on
Reset
Value on
all other
RESETS
01h, 101h
TMR0
Timer0 Module Register
xxxx xxxx
uuuu uuuu
0Bh, 8Bh,
10Bh, 18Bh
INTCON
GIE
PEIE
TMR0IE
INTE
RBIE
TMR0IF
INTF
RBIF
0000 000x
0000 000u
81h, 181h
OPTION RBPU INTEDG
T0CS
T0SE
PSA
PS2
PS1
PS0
1111 1111
85h
TRISA
PORTA Data Direction Control Register
--11 1111
Legend: x = unknown, u = unchanged, - = unimplemented locations read as '0'.
Shaded cells are not used by Timer0.
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