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参数资料
| 型号： | PM7351-BI |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | OCTAL SERIAL LINK MULTIPLEXER |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA304 |
| 封装： | 31 X 31 MM, 1.51 MM HEIGHT, 1.27 MM PITCH, SBGA-304 |
| 文件页数： | 57/174页 |
| 文件大小： | 1790K |
| 代理商： | PM7351-BI |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页当前第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页
RELEASED
PM7351 S/UNI-VORTEX
DATA SHEET
PMC-1980582
ISSUE 5
OCTAL SERIAL LINK MULTIPLEXER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
47
received. When the count becomes zero, a rising edge is generated on RX8K.
If the value of TREF[5:0] is all ones, RX8K remains low. RX8K is left asserted
for two high speed (REFCLK) reference clock periods, and then it is deasserted.
The recovered timing event is generated one cell period later than the inserted
timing with a resolution of one byte. Because of the limited resolution, some
jitter is present. At a link rate of 155.52 Mb/s, 63ns of peak-to-peak jitter will
occur on RX8K. An external local high-Q phase locked loop (PLL) can be used
to remove the jitter.
9.5 JTAG Test Access Port
The JTAG Test Access Port block provides JTAG support for boundary scan.
The standard JTAG EXTEST, SAMPLE, BYPASS, IDCODE and STCTEST
instructions are supported. The S/UNI-VORTEX identification code is 173510CD
hexadecimal.
9.6 Microprocessor Interface
The microprocessor interface is provided for device configuration, control and
monitoring by an external microprocessor. Normal mode registers and test mode
registers can be accessed through this port. Test mode registers are used to
enhance the testability of the S/UNI-VORTEX.
The interface has an 8-bit wide data bus. Multiplexed address and data
operation is supported.
9.6.1 Inband Communication Channel
To provide flexibility, two mechanisms are being provided for the transport of a
control channel. Control channel cells can be inserted and extracted either via
the microprocessor interface or via an external device transferring control
channel cells across the SCI-PHY/Any-PHY interfaces.
The control channel cell insertion and extraction capabilities provide a simple
unacknowledged (but flow controlled) cell relay capability. For a fully robust
control channel implementation, it is assumed the local microprocessor and the
remote entity are running a reliable communications protocol.
9.6.2 Insertion and Extraction Via the SCI-PHY/Any-PHY Interfaces
Control channel cells inserted via the downstream Any-PHY interface are treated
in the same manner as normal data traffic with respect to flow control, buffering,
and cell format.. The transmitting of control cells across the high-speed serial
相关PDF资料 |
PDF描述 |
|---|---|
| PM7364 | Frame Engine and Datalink Manager |
| PM7364-BI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7366 | FRAME ENGINE AND DATA LINK MANAGER |
| PM7366-BI | TVS BI-DIR 30V 1500W DO-201 |
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PM-736 | 制造商:Eclipse Tools 功能描述: |
| PM7364 | 制造商:PMC 制造商全称:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7364-BI | 制造商:PMC-Sierra 功能描述:PROTOCOL CONTROLLER, 256 Pin, BGA |
| PM7366 | 制造商:PMC 制造商全称:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
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