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参数资料
| 型号： | R5F6445FKFB |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 64 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 125/575页 |
| 文件大小： | 7685K |
| 代理商： | R5F6445FKFB |
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R01UH0218EJ0110 Rev.1.10
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Sep 12, 2011
R32C/142 Group and R32C/145 Group
13. DMAC II
The following are the details on the DMAC II index. These parameters should be aligned in the order
listed in Table 13.2 according to the transfer mode to be used.
Transfer mode (MOD)
Set a transfer mode in 2 bytes. Refer to Figure 13.3 for details on the setting of MOD.
Transfer counter (COUNT)
Set a number of transfers in 2 bytes.
Source address (SADR)
Set a source address or immediate data in 4 bytes. Note that the two upper bytes of immediate
data are ignored.
Operation address (OADR)
Set an address in a to-be calculated memory in 4 bytes. This data setting is required only for the
calculation transfer.
Destination address (DADR)
Set a destination address in 4 bytes.
Chained transfer base address (CADR)
Set the start address of the DMAC II index for the next transfer (BASE) in 4 bytes. This data setting
is required only for the chained transfer.
DMA II transfer complete interrupt vector address (IADR)
Set a jump address for the DMA II transfer complete interrupt handler in 4 bytes. This data setting
is required only for the DMA II transfer complete interrupt.
The symbols above are hereinafter used in place of their respective parameters.
Table 13.2
DMAC II Index Configuration
Transfer
Data
Memory-to-memory Transfer/
Immediate Data Transfer
Calculation Transfer
Multiple
Transfer
Chained
transfer
Not used
Used
Not used
Used
Not used
Used
Not used
Used
Not
available
DMA II
transfer
complete
interrupt
Not used Not used
Used
Not used Not used
Used
Not
available
DMAC II
index
MOD
COUNT
SADR
DADR
12 bytes
MOD
COUNT
SADR
DADR
CADR
16 bytes
MOD
COUNT
SADR
DADR
IADR
16 bytes
MOD
COUNT
SADR
DADR
CADR
IADR
20 bytes
MOD
COUNT
SADR
OADR
DADR
16 bytes
MOD
COUNT
SADR
DADR
CADR
20 bytes
OADR
MOD
COUNT
SADR
DADR
IADR
20 bytes
OADR
MOD
COUNT
SADR
DADR
CADR
24 bytes
OADR
IADR
MOD
COUNT
SADR1
DADR1
i = 1 to 7
max. 60
bytes
(when i = 7)
SADRi
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