参数资料
型号: RCPXA272FC0312
厂商: INTEL CORP
元件分类: 微控制器/微处理器
英文描述: 312 MHz, MICROPROCESSOR, PBGA336
封装: 14 X 14 MM, 1.55 MM HEIGHT, 0.65 MM PITCH, LEAD FREE, CSP-336
文件页数: 108/138页
文件大小: 1048K
代理商: RCPXA272FC0312
Part 2: Flash Device Operations
Flash Read Operations
Intel PXA27x Processor Family Memory Subsystem
71
10.3.1
Flash Read Mode
The flash Read Mode (RM) bit selects synchronous burst-mode or asynchronous page-mode
operation for the flash. When the RM bit is set, asynchronous page-mode is selected (default).
When RM is cleared, synchronous burst-mode is selected.
Table 23.
Flash Read Configuration Register Description
Read Configuration Register (RCR)
Read
Mode
RES
Latency Count
RES
Data
Hold
RES
Burst
Seq
F-CLK
Edge
RES
Burst
Wrap
Burst Length
RM
R
LC[2:0]
R
DH
R
BS
CE
R
BW
BL[2:0]
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Bit
Name
Description
15
Read Mode (RM)
0 = Synchronous burst-mode read
1 = Asynchronous page-mode read (default)
14
Reserved (R)
Reserved bits should be cleared (0)
13:11
Latency Count (LC[2:0])
010 =Code 2
011 =Code 3
100 =Code 4
101 =Code 5
110 =Code 6
111 =Code 7 (default)
Other bit settings are reserved.
10
Reserved (R)
Default to an active high (1)
9
Data Hold (DH)
0 = Data held for a 1-clock data cycle
1 = Data held for a 2-clock data cycle (default)
8
Reserved (R)
Default to an active high (1)
7
Burst Sequence (BS)
0 = Reserved
1 = Linear (default)
6
Clock Edge (CE)
0 = Falling edge
1 = Rising edge (default)
5:4
Reserved (R)
Reserved bits should be cleared (0)
3
Burst Wrap (BW)
0 = Wrap; Burst accesses wrap within burst length set by BL[2:0]
1 = No Wrap; Burst accesses do not wrap within burst length (default)
2:0
Burst Length (BL[2:0])
001 =Reserved
010 =8-word burst
011 =16-word burst
111 =Reserved (default)
Other bit settings are reserved.
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PDF描述
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