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参数资料
| 型号： | S1D13A05F00A100 |
| 元件分类： | 显示控制器 |
| 英文描述： | 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121 |
| 封装： | LEAD FREE, PLASTIC, FBGA-121 |
| 文件页数： | 84/592页 |
| 文件大小： | 5281K |
| 代理商： | S1D13A05F00A100 |
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Page 168
Epson Research and Development
Vancouver Design Center
S1D13A05
Hardware Functional Specification
X40A-A-001-04
Issue Date: 2003/05/01
Revision 4.0
11 Display Data Formats
The following diagrams show the display mode data formats for a little-endian system.
Figure 11-1: 4/8/16 Bit-Per-Pixel Display Data Memory Organization
Note
1. The Host-to-Display mapping shown here is for a little endian system.
2. For 16 bpp format, Rn, Gn, Bn represent the red, green, and blue color components.
4 bpp:
A0
B0
C0
D0
A1
B1
C1
D1
Host Address
Display Memory
A2
B2
C2
D2
A3
B3
C3
D3
bit 7
bit 0
A4
B4
C4
D4
A5
B5
C5
D5
Host Address
Display Memory
bit 7
bit 0
8 bpp:
A0
B0
C0
D0
E0
F0
G0 H0
A1
B1
C1
D1
E1
F1
G1 H1
A2
B2
C2
D2
E2
F2
G2 H2
Byte 0
Byte 1
Byte 2
Byte 0
Byte 1
Byte 2
Panel Display
P0P1P2 P3P4P5P6 P7
Panel Display
P0P1P2 P3P4P5P6 P7
(An, Bn, Cn, Dn, En, Fn, Gn, Hn)
16 bpp:
R0
4
Host Address
Display Buffer
bit 7
bit 0
R0
3
R0
2 R
0
1
R0
0
G0
5 G
0
4 G
0
3
G0
2 G
0
1
G0
0 B
0
4
B0
3
B0
2
B0
1
B0
0
R1
4
R1
3
R1
2 R
1
R1
0
G1
5 G
1
4 G
1
3
G1
2 G
1
G1
0 B
1
4
B1
3
B1
2
B1
1
B1
0
5-6-5 RGB
Byte 0
Byte 1
Byte 2
Byte 3
Panel Display
P0P1P2 P3P4P5P6 P7
Pn = (Rn
4-0, G
n
5-0, B
n
4-0)
2 bpp:
A0
B0
A1
B1
A2
B2
A3
B3
Host Address
Display Memory
A4
B4
A5
B5
A6
B6
A7
B7
bit 7
bit 0
A8
B8
A9
B9
A10 B10 A11 B11
Byte 0
Byte 1
Byte 2
Panel Display
P0P1P2 P3P4P5P6 P7
1 bpp:
A0
A1
A2
A3
A4
A5
A6
A7
Host Address
Display Memory
A8
A9
A10 A11 A12 A13 A14 A15
bit 7
bit 0
A16 A17 A18 A19 A20 A21 A22 A23
Byte 0
Byte 1
Byte 2
Panel Display
P0P1P2 P3P4P5P6 P7
LUT
Bypasses LUT
Pn = RGB value from LUT
Index (An, Bn, Cn, Dn)
Pn = RGB value from LUT
Index (An, Bn)
Pn = RGB value from LUT
Index (An)
Pn = RGB value from LUT Index
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PDF描述 |
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参数描述 |
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