参数资料
型号: S3C72N5XX-QW
元件分类: 微控制器/微处理器
英文描述: 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PQFP80
封装: 14 X 20 MM, QFP-80
文件页数: 214/215页
文件大小: 1419K
代理商: S3C72N5XX-QW
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S3C72N8/P72N8/C72N5/P72N5
INTERRUPTS
7-9
EXTERNAL INTERRUPT0 and INTERRUPT1 MODE REGISTERS (Continued)
When a sampling clock rate of fxx/64 is used for INT0, an interrupt request flag must be cleared before 16
machine cycles have elapsed. Since the INT0 pin has a clock-driven noise filtering circuit built into it, please take
the following precautions when you use it:
— To trigger an interrupt, the input signal width at INT0 must be at least two times wider than the pulse width of
the clock selected by IMOD0. This is true even when the INT0 pin is used for general-purpose input.
IRQ1
IMOD1
INT1
P1.1
Noise Filter
IRQ0
INT0
Edge
Clock Selector
CPU Clock
fxx/64
Edge
IMOD0
P1.0
Figure 7-5. Circuit Diagram for INT0 and INT1 Pins
When modifying the IMOD registers, it is possible to accidentally set an interrupt request flag. To avoid unwanted
interrupts, take these precautions when writing your programs:
1.
Disable all interrupts with a DI instruction.
2.
Modify the IMOD register.
3.
Clear all relevant interrupt request flags.
4.
Enable the interrupt by setting the appropriate IEx flag.
5.
Enable all interrupts with an EI instructions.
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