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参数资料
| 型号： | SI5364-H-BL |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 6/38页 |
| 文件大小： | 0K |
| 描述： | IC CLK MULT SONET/SDH 99-PBGA |
| 标准包装： | 168 |
| 系列： | DSPLL® |
| 类型： | 时钟发生器，扇出缓冲器（分配） |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:4 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 675MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -20°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 99-LBGA |
| 供应商设备封装： | 99-BGA（11x11） |
| 包装： | 托盘 |
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Si5364
14
Rev. 2.5
Figure 7. Si5364 Typical Application Circuit (3.3 V Supply)
10 k
Ω 1%
DSBLFOS
LOS_A
FOS_A
LOS_B
FOS_B
LOS_F
REF/CLKIN_F+
CLKIN_A+
SMC/S3N
AUTOSEL
VALTIME
RVRT
CLKIN_A–
CLKIN_B+
CLKIN_B–
REF/CLKIN_F–
19.44 MHz Clock Source 2
19.44 MHz Frequency Reference
19.44 MHz Clock Source 1
Loss of Signal (LOS)
and
Frequency Offset (FOS)
Alarm Signals
Clock Input Selection
and
Control Signals
A_A
C
TV
B_A
C
TV
F_
A
C
TV
DH
_
A
C
T
V
RSTN
/C
A
L
FEC[
1
:0
]
BW
SEL
[1
:0
]
Reference Clock
Status Indicators
PLL Bandwidth Select
FEC 255/238—238/255
Reset Control
FRQSEL_2[1:0]
CLKOUT_2+
DSBLFSYNC
FSYNC
CAL_ACTV
SYNCIN
CLKOUT_2–
FRQSEL_4[1:0]
CLKOUT_4+
CLKOUT_4–
FRQSEL_3[1:0]
CLKOUT_3+
CLKOUT_3–
FRQSEL_1[1:0]
CLKOUT_1+
CLKOUT_1–
Clock Output 1
(19, 155, or 622 MHz)
Clock Output 2
(19, 155, or 622 MHz)
Clock Output 1
Frequency Select
Clock Output 2
Frequency Select
Clock Output 3
(19, 155, or 622 MHz)
Clock Output 3
Frequency Select
Clock Output 4
(19, 155, or 622 MHz)
Clock Output 4
Frequency Select
Calibration Active
Status Output
8 kHz FSync Output
Disable FSync Control
FSync Alignment
Sync Pulse Input
RE
XT
V
SEL3
3
VDD
2
5
VDD
3
GN
D
0.1
μF
3.3 V Supply
2200 pF
22 pF
33
μF
Si5364
MANCNTRL[1:0]
INCDELAY
DECDELAY
FXDDELAY
Ferrite Bead
0.1
μF
0.1
μF
100
Ω
0.1
μF
0.1
μF
100
Ω
0.1
μF
0.1
μF
100
Ω
0.1
μF
0.1
μF
0.1
μF
0.1
μF
0.1
μF
0.1
μF
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PDF描述 |
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