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参数资料
| 型号： | SME5224AUPA-360 |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 64-BIT, 360 MHz, RISC PROCESSOR |
| 文件页数： | 15/28页 |
| 文件大小： | 373K |
| 代理商： | SME5224AUPA-360 |
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22
SME5224AUPA-360
360 MHz CPU, 4.0 MB E-Cache
UltraSPARC-II CPU Module
July 1999
Sun Microsystems, Inc
JTAG TESTABILITY
The UltraSPARC–II, 360 MHz CPU, 4.0 Mbyte E-cache module, (SME5224AUPA-360), implements the IEEE
1149.1 standard to aid in board level testing. Boundary Scan Description Language (BSDL) les are available
for all the active devices on the module, except the clock buffer.
AC Characteristics - JTAG Timing
Symbol
Parameter
Signals
Conditions
360 MHz CPU
10 MHz TCK
Units
Min
Typ
Max
t
W (TRST)
Test reset pulse width
TRST [1]
1. TRST is an asynchronous reset.
–
––
–
ns
t
SU (TDI)
Input setup time to TCK
TDI
–
3
–
ns
t
SU (TMS)
Input setup time to TCK
TMS
–
4
–
ns
t
H(TDI)
Input hold time to TCK
TDI
–
1.5
–
ns
t
H(TMS)
Input hold time to TCK
TMS
–
1.5
–
ns
t
PD(TDO)
Output delay from TCK [2]
2. TDO is referenced from falling edge of TCK.
TDO
I
OL = 8 mA
I
OH = -4 mA
C
L = 35 pF
V
LOAD = 1.5V
–6
–
ns
t
OH(TDO)
Output hold time from TCK [2]
TDO
3
–
ns
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