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参数资料
| 型号： | SPAK56F826BU80 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 16-BIT, 80 MHz, OTHER DSP, PQFP100 |
| 封装： | LQFP-100 |
| 文件页数： | 11/53页 |
| 文件大小： | 829K |
| 代理商： | SPAK56F826BU80 |
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Supply Voltage Sequencing and Separation Cautions
MOTOROLA
DSP56F826 Preliminary Technical Data
19
Figure 3. Maximum Run Idd vs. Frequency (see Note 1 above)
3.3 Supply Voltage Sequencing and Separation Cautions
Notes: 1. VDD rising before VDDIO, VDDA
2. VDDIO, VDDA rising much faster than VDD
Figure 4. Supply Voltage Sequencing and Separation Cautions
VDD should not be allowed to rise early (1). This is usually avoided by running the regulator for the VDD
supply (2.5V) from the voltage generated by the 3.3V VDDIO supply, see Figure 5. This keeps VDD from
rising faster than VDDIO.
125
100
75
50
25
0
Id
d
(m
A)
Digital (VDD=3.6V)
Analog (VDDA=3.6V)
Total
Freq. (MHz)
0
40
60
80
20
3.3V
2.5V
Time
0
2
1
Supplies Stable
VDD
VDDIO, VDDA
D
C
Power
Suppl
y
V
o
lt
age
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