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参数资料
| 型号： | SPAKD56366PV120 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 24-BIT, 120 MHz, OTHER DSP, PQFP144 |
| 封装： | TQFP-144 |
| 文件页数： | 99/147页 |
| 文件大小： | 2156K |
| 代理商： | SPAKD56366PV120 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页当前第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页
Specifications
External Memory Expansion Port (Port A)
MOTOROLA
DSP56366 Advance Information
2-25
Table 2-12 DRAM Page Mode Timings, Four Wait States1, 2, 3
No.
Characteristics
Symbol
Expression
Min
Max
131
Page mode cycle time for two consecutive accesses of the same
direction.
tPC
5
× TC
41.7
—
ns
Page mode cycle time for mixed (read and write) accesses
4.5
× TC
37.5
—
132
CAS assertion to data valid (read)
tCAC
2.75
× TC 7.0
—
15.9
ns
133
Column address valid to data valid (read)
tAA
3.75
× TC 7.0
—
24.2
ns
134
CAS deassertion to data not valid (read hold time)
tOFF
0.0
—
ns
135
Last CAS assertion to RAS deassertion
tRSH
3.5
× TC 4.0
25.2
—
ns
136
Previous CAS deassertion to RAS deassertion
tRHCP
6
× TC 4.0
46.0
—
ns
137
CAS assertion pulse width
tCAS
2.5
× TC 4.0
16.8
—
ns
138
Last CAS deassertion to RAS assertion5
BRW[1:0] = 00
tCRP
2.75
× TC 6.0
—
ns
BRW[1:0] = 01
4.25
× TC 6.0
—
BRW[1:0] = 10
5.25
× TC 6.0
37.7
—
BRW[1:0] = 11
7.25
× TC 6.0
54.4
—
139
CAS deassertion pulse width
tCP
2
× TC 4.0
12.7
—
ns
140
Column address valid to CAS assertion
tASC
TC 4.0
4.3
—
ns
141
CAS assertion to column address not valid
tCAH
3.5
× TC 4.0
25.2
—
ns
142
Last column address valid to RAS deassertion
tRAL
5
× TC 4.0
37.7
—
ns
143
WR deassertion to CAS assertion
tRCS
1.25
× TC 4.0
6.4
—
ns
144
CAS deassertion to WR assertion
tRCH
1.25
× TC 4.0
6.4
—
ns
145
CAS assertion to WR deassertion
tWCH
3.25
× TC 4.2
22.9
—
ns
146
WR assertion pulse width
tWP
4.5
× TC 4.5
33.0
—
ns
147
Last WR assertion to RAS deassertion
tRWL
4.75
× TC 4.3
35.3
—
ns
148
WR assertion to CAS deassertion
tCWL
3.75
× TC 4.3
26.9
—
ns
149
Data valid to CAS assertion (write)
tDS
0.5
× TC 4.0
0.2
—
ns
150
CAS assertion to data not valid (write)
tDH
3.5
× TC 4.0
25.2
—
ns
151
WR assertion to CAS assertion
tWCS
1.25
× TC 4.3
6.1
—
ns
152
Last RD assertion to RAS deassertion
tROH
4.5
× TC 4.0
33.5
—
ns
153
RD assertion to data valid
tGA
3.25
× TC 7.0
—
20.1
ns
154
RD deassertion to data not valid6
tGZ
0.0
—
ns
155
WR assertion to data active
0.75
× TC 0.3
5.9
—
ns
156
WR deassertion to data high impedance
0.25
× TC
—2.1
ns
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PDF描述 |
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