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参数资料
| 型号： | SPMC68336GMFT20 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP160 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 142/440页 |
| 文件大小： | 5622K |
| 代理商： | SPMC68336GMFT20 |
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MC68336/376
CONFIGURABLE TIMER MODULE 4
MOTOROLA
USER’S MANUAL
Rev. 15 Oct 2000
10-6
Figure 10-3 FCSM Block Diagram
10.6.1 FCSM Counter
The FCSM counter consists of a 16-bit register and a 16-bit up-counter. Reading the
register transfers the contents of the counter to the data bus, while a write to the
register loads the counter with a new value. Overflow of the counter is defined to be
the transition from $FFFF to $0000. An overflow condition sets the counter overflow
flag (COF) in the FCSM status/interrupt/control register (FCSMSIC).
NOTE
Reset presets the counter register to $0000. Writing $0000 to the
counter register while the counter’s value is $FFFF does not set the
COF flag and does not generate an interrupt request.
10.6.2 FCSM Clock Sources
The FCSM has eight software selectable counter clock sources, including:
Six CPSM prescaler outputs (PCLK[1:6])
Rising edge on CTM2C input
Falling edge on the CTM2C input
The clock source is selected by the CLK[2:0] bits in FCSMSIC. When the CLK[2:0] bits
are being changed, internal circuitry guarantees that spurious edges occurring on the
CTM2C pin do not affect the FCSM. The read-only IN bit in FCSMSIC reflects the state
of CTM2C. This pin is Schmitt-triggered and is synchronized with the system clock.
The maximum allowable frequency for a clock input on CTM2C is fsys/4.
CTM FCSM BLOCK
16-bit
IL2
IL1
IL0 IARB3
COF
Edge
Time base buses
IL1
Interrupt
Clock
IN
CLK1 CLK0
CLK2
Overflow
Bus
Control register bits
DRVA DRVB
Control register bits
6 clocks (PCLK[1:6]) from prescaler
Submodule bus
control
select
detect
TBBA
TBBB
INPUT pin
CTM2C
up counter
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