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参数资料
| 型号： | ST7PL35F2UA/XXXE |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, QCC20 |
| 封装： | 5 X 6 MM, ROHS COMPLIANT, QFN-20 |
| 文件页数： | 52/168页 |
| 文件大小： | 2955K |
| 代理商： | ST7PL35F2UA/XXXE |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页当前第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页
Obsolete
Product(s)
- Obsolete
Product(s)
ST7L34, ST7L35, ST7L38, ST7L39
145/168
ELECTRICAL CHARACTERISTICS (cont’d)
13.9 CONTROL PIN CHARACTERISTICS
13.9.1 Asynchronous RESET Pin
TA = -40 to +125°C, unless otherwise specified
Table 28. Asynchronous RESET Pin Characteristics
Notes:
1. Data based on characterization results, not tested in production.
2. The IIO current sunk must always respect the absolute maximum rating specified in section 13.2.2 on page 128 and
the sum of IIO (I/O ports and control pins) must not exceed IVSS.
3. The RON pull-up equivalent resistor is based on a resistive transistor. Specified for voltages on RESET pin between
VILmax and VDD
4. To guarantee the reset of the device, a minimum pulse has to be applied to the RESET pin. All short pulses applied on
RESET pin with a duration below th(RSTL)in can be ignored.
5. Guaranteed by design. Not tested in production.
Figure 95. RESET Pin Protection When LVD Is Enabled1)2)3)4)
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIL
Input low level voltage
VSS - 0.3
0.3 x VDD
V
VIH
Input high level voltage
0.7 x VDD
VDD + 0.3
Vhys
Schmitt trigger voltage
hysteresis1)
1
VOL
Output low level voltage2)
VDD = 5V
IIO = +5mA TA ≤ +85°C
TA ≤ +125°C
0.5
1.05)
1.25)
IIO = +2mA TA ≤ +85°C
TA ≤ +125°C
0.45
0.75)
0.95)
RON
Pull-up equivalent resistor1)3)
VDD = 5V
10
39
70
k
tw(RSTL)out Generated reset pulse duration
Internal reset sources
30
s
th(RSTL)in External reset pulse hold time
4)
20
tg(RSTL)in Filtered glitch duration
200
ns
0.01F
ST7
PULSE
GENERATOR
Filter
RON
VDD
INTERNAL
RESET
EXTERNAL
Required
1M
Optional
(note 3)
WATCHDOG
LVD RESET
ILLEGAL OPCODE5)
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PDF描述 |
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