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参数资料
| 型号： | STR750FV2H6 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 48 MHz, RISC MICROCONTROLLER, PBGA100 |
| 封装： | 10 X 10 MM, 1.70 MM HEIGHT, ROHS COMPLIANT, LFBGA-100 |
| 文件页数： | 43/84页 |
| 文件大小： | 1656K |
| 代理商： | STR750FV2H6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页当前第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页
Electrical parameters
STR750Fxx STR751Fxx STR752Fxx STR755Fxx
difference between N+1 consecutive clock rising edges and Tmin is the minimum time
difference between N+1 consecutive clock rising edges.
N should be kept sufficiently large to have a long term jitter (ex: thousands).
For N=1, this becomes the single period jitter.
See Figure 23
●
Cycle-to-cycle jitter (N period jitter)
This corresponds to the time variation between adjacent cycles over a random sample
of adjacent clock cycles pairs. Jitter(cycle-to-cycle) = Max(Tcycle n- Tcycle n-1) for n=1
to N.
See Figure 24
Figure 23.
Self-referred jitter (single and long term)
Figure 24.
Cycle-to-cycle jitter
IDEAL
CK_PLL
trigger point
ACTUAL
CK_PLL
nn+1
n+N
---
long term
jitter
T
single period
jitter
IDEAL
CK_PLL
ACTUAL
CK_PLL
nn+1
T
Tcycle 1
Tcycle 2
n+2
---
Tcycle N-1
n+N
相关PDF资料 |
PDF描述 |
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