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参数资料
| 型号： | TMS320C6416TBZLZD1 |
| 厂商： | Texas Instruments |
| 文件页数： | 141/146页 |
| 文件大小： | 0K |
| 描述： | IC FIXED-POINT DSP 532-FCBGA |
| 标准包装： | 60 |
| 系列： | TMS320C6414T/15T/16T |
| 类型： | 定点 |
| 接口： | 主机接口，McBSP，PCI，UTOPIA |
| 时钟速率： | 1.0GHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 1.03MB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | -40°C ~ 90°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 532-BFBGA，FCBGA |
| 供应商设备封装： | 532-FCBGA（23x23） |
| 包装： | 托盘 |
| 配用： | 701891-ND - KIT STARTER DSP FOR C6416T TMDXEVM6452-ND - TMDXEVM6452 296-23038-ND - DSP STARTER KIT FOR TMS320C6416 |
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TMS320C6414T, TMS320C6415T, TMS320C6416T
FIXEDPOINT DIGITAL SIGNAL PROCESSORS
SPRS226M NOVEMBER 2003 REVISED APRIL 2009
94
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
SYNCHRONOUS DRAM TIMING
timing requirements for synchronous DRAM cycles for EMIFA module (see Figure 27)
NO.
600
720
850
1G
UNIT
MIN
MAX
6
tsu(EDV-EKO1H)
Setup time, read EDx valid before ECLKOUTx high
0.6
ns
7
th(EKO1H-EDV)
Hold time, read EDx valid after ECLKOUTx high
CVDD = 1.2 V
1.8
ns
7
th(EKO1H-EDV)
Hold time, read EDx valid after ECLKOUTx high
CVDD = 1.1 V
2.0
ns
These C64x devices have two EMIFs (EMIFA and EMIFB). All EMIFA signals are prefixed by an “A” and all EMIFB signals are prefixed by a
“B”. Throughout the rest of this document, in generic EMIF areas of discussion, the prefix “A” or “B” may be omitted [e.g., the synchronous DRAM
memory access signals are shown as generic ( SDCAS, SDWE, and SDRAS ) instead of ASDCAS, ASDWE, and ASDRAS (for EMIFA) and
BSDCAS, BSDWE, and BSDRAS (for EMIFB)].
switching characteristics over recommended operating conditions for synchronous DRAM cycles
for EMIFA module (see Figure 27Figure 34)
NO.
PARAMETER
600
720
850
1G
UNIT
MIN
MAX
1
td(EKO1H-CEV)
Delay time, ECLKOUTx high to CEx valid
1.3
4.9
ns
2
td(EKO1H-BEV)
Delay time, ECLKOUTx high to BEx valid
4.9
ns
3
td(EKO1H-BEIV)
Delay time, ECLKOUTx high to BEx invalid
1.3
ns
4
td(EKO1H-EAV)
Delay time, ECLKOUTx high to EAx valid
4.9
ns
5
td(EKO1H-EAIV)
Delay time, ECLKOUTx high to EAx invalid
1.3
ns
8
td(EKO1H-CASV)
Delay time, ECLKOUTx high to SDCAS valid
1.3
4.9
ns
9
td(EKO1H-EDV)
Delay time, ECLKOUTx high to EDx valid
4.9
ns
10
td(EKO1H-EDIV)
Delay time, ECLKOUTx high to EDx invalid
1.3
ns
11
td(EKO1H-WEV)
Delay time, ECLKOUTx high to SDWE valid
1.3
4.9
ns
12
td(EKO1H-RAS)
Delay time, ECLKOUTx high to SDRAS valid
1.3
4.9
ns
13
td(EKO1H-ACKEV)
Delay time, ECLKOUTx high to ASDCKE valid (EMIFA only)
1.3
4.9
ns
14
td(EKO1H-PDTV)
Delay time, ECLKOUTx high to PDT valid
1.3
4.9
ns
These C64x devices have two EMIFs (EMIFA and EMIFB). All EMIFA signals are prefixed by an “A” and all EMIFB signals are prefixed by a
“B”. Throughout the rest of this document, in generic EMIF areas of discussion, the prefix “A” or “B” may be omitted [e.g., the synchronous DRAM
memory access signals are shown as generic ( SDCAS, SDWE, and SDRAS ) instead of ASDCAS, ASDWE, and ASDRAS (for EMIFA) and
BSDCAS, BSDWE, and BSDRAS (for EMIFB)].
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PDF描述 |
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参数描述 |
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