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参数资料
| 型号： | TPS65072TRSLRQ1 |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 电源管理 |
| 英文描述： | POWER SUPPLY SUPPORT CKT, PQCC48 |
| 封装： | 6 X 6 MM, 0.4 MM PITCH, PLASTIC, QFN-48 |
| 文件页数： | 55/90页 |
| 文件大小： | 1375K |
| 代理商： | TPS65072TRSLRQ1 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页当前第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页
www.ti.com
SLVSAP7 – JANUARY 2011
OUTPUT VOLTAGE
B5
B4
B3
B2
B1
B0
[V]
2.750
1
0
2.800
1
0
1
2.850
1
0
1
0
2.900
1
0
1
3.000
1
0
3.100
1
0
1
3.200
1
0
3.300
1
DEFSLEW. Register Address: 15h
DEFSLEW
B7
B6
B5
B4
B3
B2
B1
BO
Bit name and function
SLEW2
SLEW1
SLEW0
Default
0
1
0
Default value loaded by:
UVLO
Read/write
R
R/W
The DEFSLEW register defines the slew rate of the output voltage for DCDC2 and DCDC3 in case the voltage is
changed during operation. In case Bit “LDO2 tracking“ in register DEFLDO2 is set, this is also valid for LDO2.
When the voltage change is initiated by toggling pin DEFDCDC2 or DEFDCDC3, the start of the voltage change
is triggered by the rising or falling edge of the DEFDCDC2 or DEFDCDC3 pin. If a voltage change is done
internally
be
re-programming
register
DEFDCDC2_LOW,
DEFDCDC2_HIGH,
DEFDCDC3_LOW
or
DEFDCDC3_HIGH, the voltage change is initiated immediately after the new value has been written to the
register with the slew rate defined.
SLEW2 SLEW SLEW
VDCDC3
1
0
SLEW RATE
0
0.11 mV/ms
0
1
0.22 mV/ms
0
1
0
0.45 mV/ms
0
1
0.9 mV/ms
1
0
1.8 mV/ms
1
0
1
3.6 mV/ms
1
0
7.2 mV/ms
1
Immediate
Copyright 2011, Texas Instruments Incorporated
59
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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