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参数资料
| 型号： | TWR-ELEV |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 17/48页 |
| 文件大小： | 0K |
| 描述： | TOWER ELEVATOR BOARDS HARDWARE |
| 其它有关文件： | TWR-ELEV Dummy Schematic TWR-ELEV Functional Schematic |
| 产品培训模块： | MCF51CN Family - Ultimate Ethernet Solutions Tower System |
| 特色产品： | The Tower System |
| 标准包装： | 1 |
| 系列： | ColdFire® |
| 附件类型： | 2 个升降机板 |
| 适用于相关产品： | Freescale 电源塔系统 |
| 产品目录页面： | 734 (CN2011-ZH PDF) |
| 相关产品： | TWR-SER-ND - TOWER SERIAL I/O HARDWARE TWR-MCF51CN-ND - KIT TOWER BOARD TWR-MCF51CN-KIT-ND - KIT TOWER BOARD/SERIAL/ELEVATOR |
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MCF51CN128 ColdFire Microcontroller Data Sheet, Rev. 4
Electrical Characteristics
Freescale Semiconductor
24
Figure 14. Mini-FlexBus Write Timing
3.11
Fast Ethernet Timing Specifications
The following timing specs are defined at the chip I/O pin and must be translated appropriately to arrive at timing
specs/constraints for the physical interface.
3.11.1
Receive Signal Timing Specifications
The following timing specs meet the requirements for MII and 7-Wire style interfaces for a range of transceiver devices.
Table 13. Receive Signal Timing
Num
C
Characteristic
MII Mode
Unit
Min
Max
—
RXCLK frequency
—
25
MHz
E1
P
RXD[3:0], RXDV, RXER to RXCLK setup
5
—
ns
E2
D
RXCLK to RXD[3:0], RXDV, RXER hold
5
—
ns
E3
D
RXCLK pulse width high
35%
65%
RXCLK period
E4
D
RXCLK pulse width low
35%
65%
RXCLK period
FB_CLK
S0
S1
S2
S3
FB_R/W
FB_ALE
FB_OE
DATA[7:0]
8-bit Non-Mux’d Bus
16-bit Mux’d Bus
ADDR[19:8]
ADDR[7:0]
FB_AD[19:8]
FB_AD[7:0]
FB_CSn
S0
FB_AD[15:0]
DATA[15:0]
FB_AD[19:16]
ADDR[19:16]
ADDR[15:0]
MB1
MB2
MB3
相关PDF资料 |
PDF描述 |
|---|---|
| 2-1589449-6 | STRIP CON |
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| HFI-100505-2N2S | INDUCTOR 1.0X0.5X0.5MM 2.2NH |
相关代理商/技术参数 |
参数描述 |
|---|---|
| TWR-ELEV | 制造商:Freescale Semiconductor 功能描述:Tower System - Elevator Boards |
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