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参数资料
| 型号： | UPD720102F1-CA7-A |
| 厂商： | Renesas Electronics America |
| 文件页数： | 14/38页 |
| 文件大小： | 0K |
| 描述： | IC HOST CTLR USB2.0 3-PORT BGA |
| 标准包装： | 100 |
| 控制器类型： | USB 2.0 控制器 |
| 接口： | PCI |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -20°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 121-VFBGA |
| 供应商设备封装： | 121-FBGA（8x8） |
| 包装： | 托盘 |
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Data Sheet S17998EJ4V0DS
19
μPD720102
USB interface block
Parameter
Symbol
Conditions
Min.
Max.
Unit
Output pin impedance
ZHSDRV
40.5
49.5
Ω
Input Levels for Low-/full-speed:
High-level input voltage (drive)
VIH
2.0
V
High-level input voltage (floating)
VIHZ
2.7
3.6
V
Low-level input voltage
VIL
0.8
V
Differential input sensitivity
VDI
(D+) (D)
0.2
V
Differential common mode range
VCM
Includes VDI range
0.8
2.5
V
Output Levels for Low-/full-speed:
High-level output voltage
VOH
RL of 14.25 k
Ω to GND
2.8
3.6
V
Low-level output voltage
VOL
RL of 1.425 k
Ω to 3.6 V
0.0
0.3
V
SE1
VOSE1
0.8
V
Output signal crossover point voltage
VCRS
1.3
2.0
V
Input Levels for High-speed:
High-speed squelch detection threshold
(differential signal)
VHSSQ
100
150
mV
High-speed disconnect detection threshold
(differential signal)
VHSDSC
525
625
mV
High-speed data signaling common mode
voltage range
VHSCM
50
+500
mV
High-speed differential input signaling level
See Figure 3–2.
Output Levels for High-speed:
High-speed idle state
VHSOI
10
+10
mV
High-speed data signaling high
VHSOH
360
440
mV
High-speed data signaling low
VHSOL
10
+10
mV
Chirp J level (differential signal)
VCHIRPJ
700
1100
mV
Chirp K level (differential signal)
VCHIRPK
900
500
mV
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