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参数资料
| 型号： | UPD720102F1-CA7-A |
| 厂商： | Renesas Electronics America |
| 文件页数： | 34/38页 |
| 文件大小： | 0K |
| 描述： | IC HOST CTLR USB2.0 3-PORT BGA |
| 标准包装： | 100 |
| 控制器类型： | USB 2.0 控制器 |
| 接口： | PCI |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -20°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 121-VFBGA |
| 供应商设备封装： | 121-FBGA（8x8） |
| 包装： | 托盘 |
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Data Sheet S17998EJ4V0DS
3
μPD720102
PCI Bus Interface
: handles 32-bit 33 MHz PCI bus master and target function which comply with PCI
specification revision 2.2. The number of enabled ports is set by bit in configuration
space.
Arbiter
: arbitrates among two OHCI host controller cores and one EHCI host controller core.
OHCI Host Controller
: handles full- (12 Mbps)/low-speed (1.5 Mbps) signaling.
EHCI Host Controller
: handles high- (480 Mbps) signaling.
Root Hub
: handles USB hub function in host controller and controls connection (routing) between
host controller core and port.
PHY
: consists of high-speed transceiver, full-/low-speed transceiver, serializer, deserializer,
etc.
INTA0
: is the PCI interrupt signal for OHCI Host Controller.
SMI0
: is the interrupt signal which is specified by open host controller interface specification
for USB release 1.0a and enhanced host controller interface specification revision 1.0.
The SMI signal of each OHCI host controller and EHCI host controller appears at this
signal.
PME0
: is the interrupt signal which is specified by PCI-bus power management interface
specification revision 1.1. Wakeup signal of each host controller core appears at this
signal.
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PDF描述 |
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