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参数资料
型号： UPD720102F1-CA7-A
厂商： Renesas Electronics America
文件页数： 2/38页
文件大小： 0K
描述： IC HOST CTLR USB2.0 3-PORT BGA
标准包装： 100
控制器类型： USB 2.0 控制器
接口： PCI
电源电压： 3.135 V ~ 3.465 V
工作温度： -20°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 121-VFBGA
供应商设备封装： 121-FBGA（8x8）
包装： 托盘
Data Sheet S17998EJ4V0DS
8
μPD720102
1.
PIN INFORMATION
(1/2)
Pin Name
I/O
Normal (Test)
Buffer Type
Active
Level
Function
AD (31:0)
I/O
3.3 V PCI I/O with OR input
PCI “AD [31:0]” signal
CBE (3:0)0
I/O
3.3 V PCI I/O with OR input
PCI “C/BE [3:0]” signal
PAR
I/O
3.3 V PCI I/O with OR input
PCI “PAR” signal
FRAME0
I/O
3.3 V PCI I/O with OR input
Low
PCI “FRAME#” signal
IRDY0
I/O
3.3 V PCI I/O with OR input
Low
PCI “IRDY#” signal
TRDY0
I/O
3.3 V PCI I/O with OR input
Low
PCI “TRDY#” signal
STOP0
I/O
3.3 V PCI I/O with OR input
Low
PCI “STOP#” signal
IDSEL
I
3.3 V PCI input with OR input
High
PCI “IDSEL” signal
DEVSEL0
I/O
3.3 V PCI I/O with OR input
Low
PCI “DEVSEL#” signal
REQ0
O (I/O)
3.3 V PCI I/O with OR input
Low
PCI “REQ#” signal
GNT0
I
3.3 V PCI input with OR input
Low
PCI “GNT#” signal
PERR0
I/O
3.3 V PCI I/O with OR input
Low
PCI “PERR#” signal
SERR0
O (I/O)
3.3 V PCI I/O with OR input
Note 1
Low
PCI “SERR#” signal
INTA0
O (I/O)
3.3 V PCI I/O with OR input
Note 1
Low
PCI “INTA#” signal
PCLK
I
3.3 V PCI input with OR input
PCI “CLK” signal
VBBRST0
I
3.3 V schmitt input
Low
PCI “RST#” signal
CRUN0
I/O
3.3 V PCI I/O with OR input
Low
PCI “CLKRUN#” signal
PME0
O
N-ch open drain buffer
Low
PCI “PME#” signal
VCCRST0
I
3.3 V schmitt input
Low
PCI “RST#” signal for D3cold support
SMI0
O (I/O)
3.3 V I/O buffer
Low
System management interrupt output
XT1/SCLK
I
OSC block
System clock input or oscillator in
XT2
O
OSC block
Oscillator out
CLKSEL
I
3.3 V Input
Input clock frequency select signal
HSMODE
I
3.3 V Input
High
Hyper-Speed transfer mode enable signal
SRCLK
O (I/O)
3.3 V I/O buffer
Serial ROM clock out
SRDTA
I/O
3.3 V I/O buffer
Serial ROM data
SRMOD
I
3.3 V Input with pull down resistor
High
Serial ROM input enable
TESTEN
Note 2
I
3.3 V Input with pull down resistor
High
Test enable pin
TEST3
Note 2
I
3.3 V Input with pull down resistor
High
Test control
TEST4
Note 2
I
3.3 V Input with pull down resistor
High
Test control
Notes 1. These signals become N-ch open drain buffers in normal operation.
2. These pins must be open on board.
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PDF描述
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