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参数资料
| 型号： | UPD720102F1-CA7-A |
| 厂商： | Renesas Electronics America |
| 文件页数： | 19/38页 |
| 文件大小： | 0K |
| 描述： | IC HOST CTLR USB2.0 3-PORT BGA |
| 标准包装： | 100 |
| 控制器类型： | USB 2.0 控制器 |
| 接口： | PCI |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -20°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 121-VFBGA |
| 供应商设备封装： | 121-FBGA（8x8） |
| 包装： | 托盘 |
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Data Sheet S17998EJ4V0DS
24
μPD720102
(2/2)
Parameter
Symbol
Conditions
Min.
Max.
Unit
High-speed Source Electrical Characteristics
Rise time (10 to 90%)
tHSR
500
ps
Fall time (90 to 10%)
tHSF
500
ps
Driver waveform
See Figure 3–4.
High-speed data rate
tHSDRAT
479.760
480.240
Mbps
Microframe interval
tHSFRAM
124.9375
125.0625
μs
Consecutive microframe interval difference
tHSRFI
4 high-
speed
Bit
times
Data source jitter
See Figure 3–4.
Receiver jitter tolerance
See Figure 3–2.
Hub Event Timings
Time to detect a downstream facing port
connect event
tDCNN
2.5
2000
μs
Time to detect a disconnect event at a
hub’s downstream facing port
tDDIS
2.0
2.5
μs
Duration of driving resume to a
downstream port
tDRSMDN
Nominal
20
ms
Time from detecting downstream resume
to rebroadcast
tURSM
1.0
ms
Inter-packet delay for packets traveling in
same direction for high-speed
tHSIPDSD
88
Bit
times
Inter-packet delay for packets traveling in
opposite direction for high-speed
tHSIPDOD
8
Bit
times
Inter-packet delay for root hub response for
high-speed
tHSRSPIPD1
192
Bit
times
Time for which a Chirp J or Chirp K must
be continuously detected during reset
handshake
tFILT
2.5
μs
Time after end of device Chirp K by which
hub must start driving first Chirp K
tWTDCH
100
μs
Time for which each individual Chirp J or
Chirp K in the chirp sequence is driven
downstream during reset
tDCHBIT
40
60
μs
Time before end of reset by which a hub
must end its downstream chirp sequence
tDCHSE0
100
500
μs
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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