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参数资料
| 型号： | V85C2256164SAS8 |
| 厂商： | MOSEL-VITELIC |
| 元件分类： | DRAM |
| 英文描述： | 16M X 16 DDR DRAM, 0.8 ns, PBGA60 |
| 封装： | 0.80 X 1 MM PITCH, SOC, BGA-60 |
| 文件页数： | 3/61页 |
| 文件大小： | 814K |
| 代理商： | V85C2256164SAS8 |
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MOSEL VITELIC
V58C2256(804/404/164)S
V58C2256(804/404/164)S Rev. 1.4 October 2002
Output Data (DQ) and Data Strobe (DQS) Timing Relative to the Clock (CK)
During Read Cycles
The minimum time during which the output data (DQ) is valid is critical for the receiving device (i.e., a mem-
ory controller device). This also applies to the data strobe during the read cycle since it is tightly coupled to
the output data. The minimum data output valid time (tDV) and minimum data strobe valid time (tDQSV) are de-
rived from the minimum clock high/low time minus a margin for variation in data access and hold time due to
DLL jitter and power supply noise.
(CAS Latency = 2.5; Burst Length = 4)
T0
T1
T2
T3
T4
NOP
D0
CK, CK
Command
DQS
DQ
D2
tDQSCK(max)
tDQSCK(min)
D1
tAC(min)
tAC(max)
D3
READ
NOP
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PDF描述 |
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