参数资料
| 型号： | X9252YV24IZ-2.7 |
| 厂商： | Intersil |
| 文件页数： | 17/20页 |
| 文件大小： | 0K |
| 描述： | IC POT DGTL QUAD 24-TSSOP |
| 标准包装： | 62 |
| 系列： | XDCP™ |
| 接片： | 256 |
| 电阻（欧姆）： | 2.8k |
| 电路数： | 4 |
| 温度系数： | 标准值 ±300 ppm/°C |
| 存储器类型： | 非易失 |
| 接口： | I²C（芯片选择，设备位址，增/减） |
| 电源电压： | 2.7 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 24-TSSOP |
| 包装： | 管件 |
| 产品目录页面： | 1237 (CN2011-ZH PDF) |
6
FN8167.2
November 14, 2005
SDA vs SCL Timing
WP, A0, A1, and A2 Pin Timing
tBUF (Note 5) Bus Free Time (Prior to Any Transmission)
1200
ns
tSU:WPA
(Note 5)
A0, A1, A2 and WP Setup Time
600
ns
tHD:WPA
(Note 5)
A0, A1, A2 and WP Hold Time
600
ns
2-Wire Interface timing (s) (Continued)
SYMBOL
PARAMETER
MIN
MAX
UNITS
tSU:STO
tDH
tHIGH
tSU:STA
tHD:STA
tHD:DAT
tSU:DAT
SCL
SDA
(Input Timing)
SDA
(Output Timing)
tF
tLOW
tBUF
tAA
tR
tHD:WP
SCL
SDA IN
WP, A0, A1, or A2
tSU:WP
Clk 1
START
STOP
Increment/Decrement Timing
SYMBOL
PARAMETER
MIN
TYP (Note 4)
MAX
UNITS
tCI
CS to SCL Setup
600
ns
tID (Note 5)
SCL HIGH to U/D, DS0 or DS1 change
600
ns
tDI (Note 5)
U/D, DS0 or DS1 to SCL setup
600
ns
tIL
SCL LOW period
2.5
s
tIH
SCL HIGH period
2.5
s
tIC
SCL inactive to CS inactive (Nonvolatile Store Setup Time)
1
s
tCPHS
CS deselect time (STORE)
10
ms
tCPHNS
(Note 5)
CS deselect time (NO STORE)
1
s
tIW (Note 5)
SCL to RW change
100
500
s
tCYC
SCL cycle time
5
s
tR, tF (Note 5) SCL input rise and fall time
500
s
X9252
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PDF描述 |
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参数描述 |
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| X9258)06 | 制造商:INTERSIL 制造商全称:Intersil Corporation 功能描述:Quad Digital Controlled Potentiometers |
| X9258_11 | 制造商:INTERSIL 制造商全称:Intersil Corporation 功能描述:Quad Digital Controlled Potentiometers(XDCP?) |
| X9258_13 | 制造商:INTERSIL 制造商全称:Intersil Corporation 功能描述:Low Noise/Low Power/2-Wire Bus/256 Taps |
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