参数资料
| 型号： | XC2S100E-6FT256C |
| 厂商： | Xilinx Inc |
| 文件页数： | 41/108页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1.8V 600 CLB'S 256-FBGA |
| 产品变化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 标准包装： | 90 |
| 系列： | Spartan®-IIE |
| LAB/CLB数： | 600 |
| 逻辑元件/单元数： | 2700 |
| RAM 位总计： | 40960 |
| 输入/输出数： | 182 |
| 门数： | 100000 |
| 电源电压： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-FTBGA |
| 其它名称： | 122-1208 |
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38
DS077-3 (v3.0) August 9, 2013
Product Specification
Spartan-IIE FPGA Family: DC and Switching Characteristics
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
IOB Input Delay Adjustments for Different Standards
Input delays associated with the pad are specified for LVTTL. For other standards, adjust the delays by the values shown. A
delay adjusted in this way constitutes a worst-case limit.
Symbol
Description
Standard
Speed Grade
Units
-7
-6
Data Input Delay Adjustments
TILVTTL
Standard-specific data input delay
adjustments
LVTTL
0
ns
TILVCMOS2
LVCMOS2
0
ns
TILVCMOS18
LVCMOS18
0.20
ns
TILVDS
LVDS
0.15
ns
TILVPECL
LVPECL
0.15
ns
TIPCI33_3
PCI, 33 MHz, 3.3V
0.08
ns
TIPCI66_3
PCI, 66 MHz, 3.3V
–0.11
ns
TIGTL
GTL
0.14
ns
TIGTLP
GTL+
0.14
ns
TIHSTL
HSTL
0.04
ns
TISSTL2
SSTL2
0.04
ns
TISSTL3
SSTL3
0.04
ns
TICTT
CTT
0.10
ns
TIAGP
AGP
0.04
ns
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