参数资料
| 型号： | XC3S1200E-5FGG400C |
| 厂商： | Xilinx Inc |
| 文件页数： | 94/227页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN-3E 1200K 400FBGA |
| 标准包装： | 60 |
| 系列： | Spartan®-3E |
| LAB/CLB数： | 2168 |
| 逻辑元件/单元数： | 19512 |
| RAM 位总计： | 516096 |
| 输入/输出数： | 304 |
| 门数： | 1200000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 400-BGA |
| 供应商设备封装： | 400-FBGA（21x21） |
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
183
User I/Os by Bank
Table 142 indicates how the 158 available user-I/O pins are
distributed between the four I/O banks on the PQ208
package.
Footprint Migration Differences
The XC3S250E and XC3S500E FPGAs have identical
footprints in the PQ208 package. Designs can migrate
between the XC3S250E and XC3S500E without further
consideration.
Table 142: User I/Os Per Bank for the XC3S250E and XC3S500E in the PQ208 Package
Package
Edge
I/O Bank
Maximum I/O
All Possible I/O Pins by Type
I/O
INPUT
DUAL
VREF(1)
Top
0
38
18
6
1
5
8
Right
1
40
9
7
21
3
0(2)
Bottom
2
40
8
6
24
2
0(2)
Left
3
40
23
6
0
3
8
TOTAL
158
58
25
46
13
16
Notes:
1.
Some VREF and CLK pins are on INPUT pins.
2.
The eight global clock pins in this bank have optional functionality during configuration and are counted in the DUAL column.
相关PDF资料 |
PDF描述 |
|---|---|
| 0511171605 | CONN RETAINER FOR 16POS HOUSING |
| XC3S1200E-4FGG400I | IC FPGA SPARTAN-3E 1200K 400FBGA |
| GSC43DTEI | CONN EDGECARD 86POS .100 EYELET |
| XC6SLX25T-N3FGG484I | IC FPGA SPARTAN-6 484FBGA |
| XC3S1000-4FGG456I | SPARTAN-3A FPGA 1M STD 456-FBGA |
相关代理商/技术参数 |
参数描述 |
|---|---|
| XC3S1200E-5FGG400I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1200E-5FGG484C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1200E-5FGG484I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1200E-5FT256C | 制造商:Xilinx 功能描述:FPGA SPARTAN-3E 1.2M GATES 19512 CELLS 657MHZ 90NM 1.2V 256F - Trays |
| XC3S1200E-5FT256I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
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