参数资料
| 型号： | XC3S200A-4VQ100I |
| 厂商： | Xilinx Inc |
| 文件页数： | 80/132页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN 3 100VQFP |
| 标准包装： | 90 |
| 系列： | Spartan®-3A |
| LAB/CLB数： | 448 |
| 逻辑元件/单元数： | 4032 |
| RAM 位总计： | 294912 |
| 输入/输出数： | 68 |
| 门数： | 200000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-VQFP（14x14） |
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DC and Switching Characteristics
DS529-3 (v2.0) August 19, 2010
51
Phase Shifter (PS)
Table 40: Recommended Operating Conditions for the PS in Variable Phase Mode
Symbol
Description
Speed Grade
Units
-5
-4
Min
Max
Min
Max
Operating Frequency Ranges
PSCLK_FREQ
(FPSCLK)
Frequency for the PSCLK input
1
167
1
167
MHz
Input Pulse Requirements
PSCLK_PULSE
PSCLK pulse width as a percentage of the PSCLK period
40%
60%
40%
60%
-
Table 41: Switching Characteristics for the PS in Variable Phase Mode
Symbol
Description
Phase Shift Amount
Units
Phase Shifting Range
MAX_STEPS(2)
Maximum allowed number of
DCM_DELAY_STEP steps for a
given CLKIN clock period, where
T = CLKIN clock period in ns. If using
CLKIN_DIVIDE_BY_2 = TRUE,
double the clock effective clock
period.
CLKIN < 60
MHz
±[INTEGER(10
(T
CLKIN – 3 ns))]
steps
CLKIN
≥ 60
MHz
±[INTEGER(15
(T
CLKIN – 3 ns))]
FINE_SHIFT_RANGE_MIN
Minimum guaranteed delay for variable phase shifting
±[MAX_STEPS
DCM_DELAY_STEP_MIN]
ns
FINE_SHIFT_RANGE_MAX
Maximum guaranteed delay for variable phase shifting
±[MAX_STEPS
DCM_DELAY_STEP_MAX]
ns
Notes:
1.
2.
The maximum variable phase shift range, MAX_STEPS, is only valid when the DCM is has no initial fixed phase shifting, that is, the
PHASE_SHIFT attribute is set to 0.
3.
The DCM_DELAY_STEP values are provided at the bottom of Table 37.
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