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参数资料
| 型号： | XR17V352IB113-F |
| 厂商： | Exar Corporation |
| 文件页数： | 55/64页 |
| 文件大小： | 0K |
| 描述： | IC UART PCIE 256B DUAL 113FPBGA |
| 产品培训模块： | PCIe UARTs |
| 标准包装： | 260 |
| 特点： | * |
| 通道数： | 2，DUART |
| FIFO's： | 256 字节 |
| 规程： | RS485 |
| 电源电压： | 3.3V |
| 带自动流量控制功能： | 是 |
| 带IrDA 编码器/解码器： | 是 |
| 带故障启动位检测功能： | 是 |
| 带调制解调器控制功能： | 是 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 113-LFBGA |
| 供应商设备封装： | 113-FPBGA |
| 包装： | 托盘 |
| 其它名称： | 1016-1471 XR17V352IB113-F-ND |
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XR17V352
59
REV. 1.0.3
HIGH PERFORMANCE DUAL PCI EXPRESS UART
EFR[3:0]: Software Flow Control Select
Combinations of software flow control can be selected by programming these bits, as shown in Table 19.
TABLE 19: SOFTWARE FLOW CONTROL FUNCTIONS
TRANSMIT AND RECEIVE SOFTWARE FLOW CONTROL
0
No TX and RX flow control (default and reset)
0
X
No transmit flow control
1
0
X
Transmit Xon1, Xoff1
0
1
X
Transmit Xon2, Xoff2
1
X
Transmit Xon1 and Xon2, Xoff1 and Xoff2
X
0
No receive flow control
X
1
0
Receiver compares Xon1, Xoff1
X
0
1
Receiver compares Xon2, Xoff2
1
0
1
Transmit Xon1, Xoff1
Receiver compares Xon1 or Xon2, Xoff1 or Xoff2
0
1
Transmit Xon2, Xoff2
Receiver compares Xon1 or Xon2, Xoff1 or Xoff2
1
Transmit Xon1 and Xon2, Xoff1 and Xoff2
Receiver compares Xon1 and Xon2, Xoff1 and Xoff2
0
1
No transmit flow control
Receiver compares Xon1 and Xon2, Xoff1 and Xoff2
Software flow control can not be used when the Auto RS-485 Half-Duplex Direction Control feature is enabled
(FCTR[5]=1). With this feature enabled, the RTS#/DTR# output controls the direction of the half-duplex RS-
485 transceiver. The RTS#/DTR# output changes the direction of the half-duplex transceiver to the transmit
mode when data is being transmitted from the UART on the TX output. However, the RTS#/DTR# output will
remain in the receive direction if the TX FIFO is empty and the RX FIFO triggers an XON or XOFF character to
be transmitted.
4.15
TXCNT[7:0]: Transmit FIFO Level Counter - Read Only
Transmit FIFO level byte count from 0x00 (0 bytes) to 0xFF (255 or 256 bytes). This 8-bit register gives an
indication of the number of characters in the transmit FIFO. The FIFO level Byte count register is read only.
The user can take advantage of the FIFO level byte counter for faster data loading to the transmit FIFO, which
reduces CPU bandwidth requirements.
4.16
TXTRG [7:0]: Transmit FIFO Trigger Level - Write Only
An 8-bit value written to this register sets the TX FIFO trigger level from 0x00 (zero) to 0xFF (255). The TX
FIFO trigger level generates an interrupt whenever the data level in the transmit FIFO falls below this preset
trigger level.
4.17
RXCNT[7:0]: Receive FIFO Level Counter - Read Only
Receive FIFO level byte count from 0x00 (0 bytes) to 0xFF (255 or 256 bytes). It gives an indication of the
number of characters in the receive FIFO. The FIFO level byte count register is read only. The user can take
advantage of the FIFO level byte counter for faster data unloading from the receiver FIFO, which reduces CPU
bandwidth requirements.
EFR BIT [3]
EFR BIT [2]
EFR BIT [1]
EFR BIT [0]
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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| XR17V354 | 制造商:EXAR 制造商全称:EXAR 功能描述:HIGH PERFORMANCE QUAD PCI-EXPRESS UART |
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