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参数资料
| 型号： | XR17V352IB113-F |
| 厂商： | Exar Corporation |
| 文件页数： | 64/64页 |
| 文件大小： | 0K |
| 描述： | IC UART PCIE 256B DUAL 113FPBGA |
| 产品培训模块： | PCIe UARTs |
| 标准包装： | 260 |
| 特点： | * |
| 通道数： | 2，DUART |
| FIFO's： | 256 字节 |
| 规程： | RS485 |
| 电源电压： | 3.3V |
| 带自动流量控制功能： | 是 |
| 带IrDA 编码器/解码器： | 是 |
| 带故障启动位检测功能： | 是 |
| 带调制解调器控制功能： | 是 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 113-LFBGA |
| 供应商设备封装： | 113-FPBGA |
| 包装： | 托盘 |
| 其它名称： | 1016-1471 XR17V352IB113-F-ND |
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XR17V352
9
REV. 1.0.3
HIGH PERFORMANCE DUAL PCI EXPRESS UART
TABLE 1: PCI LOCAL BUS CONFIGURATION SPACE REGISTERS
ADDRESS
OFFSET
BITS
TYPE
DESCRIPTION
RESET VALUE
(HEX OR BINARY)
0x00
31:16
EWR
Device ID
0x0352
15:0
EWR
Vendor ID (Exar) specified by PCISIG
0x13A8
0x04
31
30
RWC
Parity error detected. Cleared by writing a logic 1.
System error detected. Cleared by writing a logic 1.
0b
29:28
RO
Unused
00b
27
RO
Target Abort.
0b
26:25
RO
DEVSEL# timing.
00b
24
RO
Unemployments bus master error reporting bit
0b
23
RO
Fast back to back transactions are supported
0b
22
RO
Reserved Status bit
0b
21
RO
66MHz capable
0b
20
RO
Capabilities List
1b
19:16
RO
Reserved Status bits
0000b
15:11,
9,7, 5,
4, 3, 2
RO
Command bits (reserved)
0x0000
10
RWR
This bit disables the device from asserting INTx#. logic 1 = dis-
able assertion of INTx# and logic 0 = enables assertion of INTx#
0b
8
RWR
SERR# driver enable. logic 1=enable driver and 0=disable driver
0b
6
RWR
Parity error enable. logic 1=respond to parity error and 0=ignore
0b
1
RWR
Command controls a device’s response to mem space accesses:
0=disable mem space accesses, 1=enable mem space accesses
0b
0
RO
Device’s response to I/O space accesses is disabled.
(0 = disable I/O space accesses)
0b
0x08
31:8
EWR
Class Code (Default is ’Simple 550 Communication Controller’)
0x070002
7:0
RO
Revision ID (Exar device revision number)
Current Rev. value
0x0C
31:24
RO
BIST (Built-in Self Test)
0x00
23:16
RO
Header Type (a single function device with one BAR)
0x00
15:8
RO
Unimplemented Latency Timer (needed only for bus master)
0x00
7:0
RO
Unimplemented Cache Line Size
0x00
0x10
31:11
RWR
Memory Base Address Register (BAR0)
0x00000
10:0
RO
Claims an 2K address space for the memory mapped UARTs
including the UARTs on the expansion interface.
0x0000
0x14
31:0
RWR
Unimplemented Base Address Register (returns zeros)
0x00000000
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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| XR17V354 | 制造商:EXAR 制造商全称:EXAR 功能描述:HIGH PERFORMANCE QUAD PCI-EXPRESS UART |
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| XR17V354IB-E8-EVB | 功能描述:界面开发工具 Eval Board for XR17V354IB-E8 RoHS:否 制造商:Bourns 产品:Evaluation Boards 类型:RS-485 工具用于评估:ADM3485E 接口类型:RS-485 工作电源电压:3.3 V |
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