参数资料
| 型号： | XRT72L54IB |
| 厂商： | Exar Corporation |
| 文件页数： | 144/484页 |
| 文件大小： | 0K |
| 描述： | IC FRAMER DS3/E3 4CH 272PBGA |
| 产品变化通告： | XRT72Lx Series Obsolescence 02/May/2012 |
| 标准包装： | 40 |
| 控制器类型： | DS3/E3 调帧器 |
| 电源电压： | 3.3V |
| 电流 - 电源： | 190mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 272-BBGA |
| 供应商设备封装： | 272-PBGA（27x27） |
| 包装： | 托盘 |
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XRT72L54
FOUR CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
á
PRELIMINARY
REV. P1.1.2
209
The Receive DS3 Framer block will also issue a
Change in OOF Status interrupt request, anytime
there is a change in the OOF status.
4.3.2.3
Forcing a Reframe via Software Com-
mand
The Framer IC permits the user to force a reframe
procedure of the Receive DS3 Framer block via soft-
ware command. If the user writes a "1" into Bit 0 the
I/O Control Register, as depicted below, then the Re-
ceive DS3 Framer will be forced into the Frame Acqui-
sition Mode, (or more specifically, in the F-Bit Search
State per Figure 81). Afterwards, the Receive DS3
Framer block will begin its search for valid F-Bits. The
Framer IC will also respond to this command by as-
serting the RxOOF output pin, and generating a
Change in OOF Status interrupt.
4.3.2.4
Performance Monitoring of the Receive
DS3 Framer block
The user can monitor the number of framing bit errors
(M and F bits) that have been detected by the Re-
ceive DS3 Framer block. This is accomplished by pe-
riodically reading the PMON Framing Bit Error Count
Registers (Address = 0x52 and 0x53), as depicted
below.
When the P/C reads these registers, it will read in
the number of framing bit errors that have been de-
tected since the last read of these two registers.
These registers are reset upon read.
4.3.2.5
DS3 Receive Alarms
The Receive DS3 Framer block is capable of detect-
ing any of the following alarm conditions.
LOS (Loss of Signal)
AIS (Alarm Indication Signal)
The Idle Pattern.
FERF (Far-End Receive Failure) of Yellow Alarm
condition.
FEBE (Far-End-Block Error)
Change in AIC State
The methods by which the Receive DS3 Framer block
uses to detect and declare each of these alarm condi-
tions are described below.
4.3.2.5.1
The Loss of Signal (LOS) Alarm
The Receive DS3 Framer block will declare a Loss of
Signal (LOS) state when it detects 180 consecutive
R/O
R/W
XX
X
XXX
XX
RX DS3 CONFIGURATION AND STATUS REGISTER, (ADDRESS = 0X10)
BIT 7BIT 6BIT 5
BIT 4BIT 3BIT2BIT 1BIT 0
I/O CONTROL REGISTER (ADDRESS = 0X01)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT2BIT 1
BIT 0
Disable
TxLOC
LOC
Disable
RxLOC
AMI/ZeroSup*
Unipolar/
Bipolar*
TxLine CLK
Invert
RxLine CLK
Invert
Reframe
R/W
RO
R/W
10
100
00
0
PMON FRAMING BIT ERROR EVENT COUNT REGISTER - MSB (ADDRESS = 0X52)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT2BIT 1BIT 0
F-Bit Error Count - High Byte
RO
10
100
000
PMON FRAMING BIT ERROR EVENT COUNT REGISTER - LSB (ADDRESS = 0X53)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT2BIT 1BIT 0
F-Bit Error Count - Low Byte
RO
00
000
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