参数资料
| 型号： | XRT72L54IB |
| 厂商： | Exar Corporation |
| 文件页数： | 194/484页 |
| 文件大小： | 0K |
| 描述： | IC FRAMER DS3/E3 4CH 272PBGA |
| 产品变化通告： | XRT72Lx Series Obsolescence 02/May/2012 |
| 标准包装： | 40 |
| 控制器类型： | DS3/E3 调帧器 |
| 电源电压： | 3.3V |
| 电流 - 电源： | 190mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 272-BBGA |
| 供应商设备封装： | 272-PBGA（27x27） |
| 包装： | 托盘 |
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á
XRT72L54
FOUR CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
PRELIMINARY
REV. P1.1.2
254
The Serial or the Nibble-Parallel Interface Mode
The Loop-Timing or the TxInClk (Local Timing)
Mode
Further, if the XRT72L54 has been configured to op-
erate in the Local-Timing mode, then the user has
two additional options.
The XRT72L54 is the Frame Master (e.g., it dictates
when the Terminal Equipment will initiate the trans-
mission of data within a new E3 frame).
The XRT72L54 is the Frame Slave (e.g., the Termi-
nal Equipment will dictate when the XRT72L54 ini-
tiates the transmission of a new E3 frame).
Given these three set of options, the Transmit Termi-
nal Input Interface can be configured to operate in
one of the six (6) following modes.
Mode 1 - Serial/Loop-Timed Mode
Mode 2 - Serial/Local-Timed/Frame Slave Mode
Mode 3 - Serial/Local-Timed/Frame Master Mode
Mode 4 - Nibble/Loop-Timed Mode
Mode 5 - Nibble/Local-Timed/Frame Slave Mode
Mode 6 - Nibble/Local-Timed/Frame Master Mode
Each of these modes are described, in detail, below.
5.2.1.1
Mode 1 - The Serial/Loop-Timing Mode
The Behavior of the XRT72L54
If the XRT72L54 has been configured to operate in
this mode, then the XRT72L54 will behave as follows.
A. Loop-Timing (Uses the RxLineClk signal as the
Timing Reference)
Since the XRT72L54 is configured to operate in the
loop-timed mode, the Transmit Section of the
XRT72L54 will use the RxLineClk input clock signal
(e.g., the Recovered Clock signal, from the LIU) as its
timing source. When the XRT72L54 is operating in
this mode it will do the following.
1. It will ignore any signal at the TxInClk input pin.
2. The XRT72L54 will output a 34.368MHz clock
signal via the RxOutClk output pin. This clock
signal functions as the Transmit Payload Data
Input Interface block clock signal.
3. The XRT72L54 will use the rising edge of the
RxOutClk signal to latch in the data residing on
the TxSer input pin.
B. Serial Mode
The XRT72L54 will accept the E3 payload data from
the Terminal Equipment, in a serial-manner, via the
TxSer input pin The Transmit Payload Data Input In-
terface will latch this data into its circuitry, on the ris-
ing edge of the RxOutClk output clock signal.
C. Delineation of outbound E3 frames
The XRT72L54 will pulse the TxFrame output pin
"High" for one bit-period coincident with the
XRT72L54 processing the last bit of a given E3
frame.
D. Sampling of Payload Data, from the Terminal
Equipment
In Mode 1, the XRT72L54 will sample the data at the
TxSer input, on the rising edge of RxOutClk.
Interfacing the Transmit Payload Data Input Inter-
face block of the XRT72L54 to the Terminal Equip-
ment for Mode 1 Operation
Figure 100 presents an illustration of the Transmit
Payload Data Input Interface block (within the
XRT72L54) being interfaced to the Terminal Equip-
ment, for Mode 1 operation.
FIGURE 100. ILLUSTRATION OF THE TERMINAL EQUIPMENT BEING INTERFACED TO THE TRANSMIT PAYLOAD DATA
INPUT INTERFACE BLOCK OF THE XRT72L54 FOR MODE 1 (SERIAL/LOOP-TIMED) OPERATION
Terminal Equipment
XRT72L5x E3 Framer
E3_Data_Out
E3_Clock_In
Tx_Start_of_Frame
E3_Overhead_Ind
TxSer
RxOutClk
TxFrame
TxOH_Ind
NibInt
34.368 MHz
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