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参数资料
| 型号： | 37M602 |
| 厂商： | SMSC Corporation |
| 英文描述： | ENHANCED SUPER I/O CONTROLLER WITH INFRARED SUPPORT |
| 中文描述： | 增强的超级I / O控制器，支持红外线 |
| 文件页数： | 101/182页 |
| 文件大小： | 650K |
| 代理商： | 37M602 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页当前第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页
25
DATA REGISTER (FIFO)
Address 3F5 READ/WRITE
All command parameter information, disk data
and result status are transferred between the
host processor and the floppy disk controller
through the Data Register.
Data transfers are governed by the RQM and
DIO bits in the Main Status Register.
The Data Register defaults to FIFO disabled
mode after any form of reset.
This maintains
PC/AT hardware compatibility.
The default
values can be changed through the Configure
command (enable full FIFO operation with
threshold control). The advantage of the FIFO
is that it allows the system
a larger DMA
latency without causing a disk error. Table 14
gives several examples of the delays with a
FIFO.
The data is based upon the following
formula:
At the start of a command, the FIFO action is
always disabled and command parameters
must be sent based upon the RQM and DIO bit
settings. As the command execution phase is
entered, the FIFO is cleared of any data to
ensure that invalid data is not transferred.
An overrun or underrun will terminate the
current command and the transfer of data. Disk
writes will complete the current sector by
generating a 00 pattern and valid CRC. Reads
require the host to remove the remaining data
so that the result phase may be entered.
Table 14 - FIFO Service Delay
FIFO THRESHOLD
EXAMPLES
MAXIMUM DELAY TO SERVICING AT 2
Mbps* DATA RATE
1 byte
2 bytes
8 bytes
15 bytes
1 x 4
s - 1.5 s = 2.5 s
2 x 4
s - 1.5 s = 6.5 s
8 x 4
s - 1.5 s = 30.5 s
15 x 4
s - 1.5 s = 58.5 s
FIFO THRESHOLD
EXAMPLES
MAXIMUM DELAY TO SERVICING AT 1
Mbps DATA RATE
1 byte
2 bytes
8 bytes
15 bytes
1 x 8
s - 1.5 s = 6.5 s
2 x 8
s - 1.5 s = 14.5 s
8 x 8
s - 1.5 s = 62.5 s
15 x 8
s - 1.5 s = 118.5 s
FIFO THRESHOLD
EXAMPLES
MAXIMUM DELAY TO SERVICING AT
500 Kbps DATA RATE
1 byte
2 bytes
8 bytes
15 bytes
1 x 16
s - 1.5 s = 14.5 s
2 x 16
s - 1.5 s = 30.5 s
8 x 16
s - 1.5 s = 126.5 s
15 x 16
s - 1.5 s = 238.5 s
*The 2 Mbps data rate is only available if VCC = 5V.
Threshold # x
1
DATA RATE
x 8
- 1.5
s = DELAY
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