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参数资料
| 型号： | A4490EES-T |
| 厂商： | Allegro Microsystems Inc |
| 文件页数： | 16/17页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK ADJ 1.5A TRPL 20QFN |
| 标准包装： | 92 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 3 |
| 输出电压： | 可调 |
| 输入电压： | 4.5 V ~ 34 V |
| PWM 型： | 电流模式 |
| 频率 - 开关： | 550kHz |
| 电流 - 输出： | 1.5A |
| 同步整流器： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-WFQFN 裸露焊盘 |
| 包装： | 管件 |
| 供应商设备封装： | 20-QFN 裸露焊盘（4x4） |
| 配用： | 620-1388-ND - BOARD EVAL FOR A4490 |
| 其它名称： | A4490SES-T A4490SES-T-ND |
A4490
Triple Output Step-Down Switching Regulator
Package ES, 20-Pin QFN
0.30
1
2
20
A
4.00 ±0.15
4.00 ±0.15
0.95
1
2
20
0.50
2.60
4.10
2.60
4.10
21X
D
0.08 C
SEATING
PLANE
C
C
PCB Layout Reference View
0.25 –0.07
+0.05
0.50
0.75 ±0.05
For Reference Only
(reference JEDEC MO-220WGGD)
Dimensions in millimeters
Exact case and lead configuration at supplier discretion within limits shown
A Terminal #1 mark area
B Exposed thermal pad (reference only, terminal #1
identifierappearanceatsupplierdiscretion)
0.40 –0.10
+0.15
2
1
B
2.60
C Reference land pattern layout (reference IPC7351
QFN50P400X400X80-21BM)
All pads a minimum of 0.20 mm from all adjacent pads; adjust as necessary
to meet application process requirements and PCB layout tolerances; when
mountingonamultilayerPCB,thermalviasattheexposedthermalpadland
can improve thermal dissipation (reference EIA/JEDEC Standard JESD51-5)
20
2.60
D Coplanarity includes exposed thermal pad and terminals
Allegro MicroSystems, LLC
115 Northeast Cutoff
Worcester, Massachusetts 01615-0036 U.S.A.
1.508.853.5000; www.allegromicro.com
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