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参数资料
| 型号： | ACS8946 |
| 元件分类： | 数字传输电路 |
| 英文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, QCC48 |
| 封装： | 7 X 7 MM, QFN-48 |
| 文件页数： | 19/40页 |
| 文件大小： | 663K |
| 代理商： | ACS8946 |
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ADVANCED COMMUNICATIONS
FINAL
DATASHEET
Revision 3/November 2006 Semtech Corp.
Page 26
www.semtech.com
ACS8946 JAM PLL
Notes: (i) Outputs running at same frequency.
(ii) Rise/fall time measured 10-90%.
(iii) Using output load specified in Figure 17.
(iv) Using output load specified in Figure 14.
(v) Using 50 Ohm load.
DC Characteristics
Across all operating conditions, unless otherwise stated.
Notes: (i) Unused differential input terminated to VDD-1.4 V.
(ii) Both pins must remain within the supply voltage, i.e. >VSS and <VDD.
Output Clock Duty Cycle
tODC
48
50
52
%
RESETB Pulse Width after Power-up
tRPW
100
-
ms
Settling Time before Start of Frequency Tuning after
RESETB High
tFT
10
-
60
ms
Table 19 AC Characteristics (cont...)
Parameter
Symbol
Minimum
Typical
Maximum
Units
Table 20 DC Characteristics: LVCMOS Input Ports with Internal Pull-down/LVCMOS Schmitt Input Port with Internal
Pull-up
Parameter
Symbol
Minimum
Typical
Maximum
Units
VIN High
VIH
2-
-
V
VIN Low
VIL
--
0.8
V
Pull-down Resistor
RPD
43
-
108
k
Pull-up Resistor (Schmitt Input)
RPU
53
-
113
k
Input Current
IIN
-10
-
+10
A
Table 21 DC Characteristics: LVPECL Input Port
Parameter
Symbol
Minimum
Typical
Maximum
Units
LVPECL Input Offset Voltage
Differential Inputs (Note (ii))
VIO_LVPECL
VDD-2.0
-
VDD-0.5
V
Input Differential Voltage
VID_LVPECL
0.1
-
1.4
V
LVPECL Input Low Voltage
Single-ended Input (Note (i))
VIL_LVPECL_S
VSS
-VDD-1.5
V
LVPECL Input High Voltage
Single-ended Input (Note (i))
VIL_LVPECL_S
VDD-1.3
-
VDD
V
Input High Current
Input Differential Voltage VID = 1.4 V
IIH_LVPECL
-10
-
+10
A
Input Low Current
Input Differential Voltage VID = 1.4 V
IIL_LVPECL
-10
-
+10
A
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