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参数资料
| 型号： | ACS8946 |
| 元件分类： | 数字传输电路 |
| 英文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, QCC48 |
| 封装： | 7 X 7 MM, QFN-48 |
| 文件页数： | 9/40页 |
| 文件大小： | 663K |
| 代理商： | ACS8946 |
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ADVANCED COMMUNICATIONS
FINAL
DATASHEET
Revision 3/November 2006 Semtech Corp.
Page 17
www.semtech.com
ACS8946 JAM PLL
8
VDD
ALARM1_CO0
Falling
100
0
9
VDD
ALARM2_CO1
Falling
100
1
10
VDD
CFG_OUT2
Falling
101
0
11
VDD
ALARMC_CO3
Falling
1
0
1
12
ALARM1_CO0
GND
Falling
110
0
13
ALARM1_CO0
VDD
Falling
110
1
14
ALARM1_CO0
Falling
1
0
15
ALARM1_CO0
ALARM2_CO1
Falling
1
16
ALARM1_CO0
CFG_OUT2
Rising
000
0
17
ALARM1_CO0
ALARMC_CO3
Rising
0
1
18
ALARM2_CO1
GND
Rising
0
1
0
19
ALARM2_CO1
VDD
Rising
0
1
20
ALARM2_CO1
ALARM1_CO0
Rising
0
1
0
21
ALARM2_CO1
Rising
0
1
0
1
22
ALARM2_CO1
CFG_OUT2
Rising
011
0
23
ALARM2_CO1
ALARMC_CO3
Rising
0
1
24
CFG_OUT2
GND
Rising
1
0
25
CFG_OUT2
VDD
Rising
1
0
1
26
CFG_OUT2
ALARM1_CO0
Rising
101
0
27
CFG_OUT2
ALARM2_CO1
Rising
101
1
28
CFG_OUT2
Rising
1
0
29
CFG_OUT2
ALARMC_CO3
Rising
110
1
30
ALARMC_CO3
GND
Rising
1
0
31
ALARMC_CO3
VDD
Rising
1
Table 12 SYNC Edge and Clock Output Configurations (cont...)
Row
No.
Wiring of Configuration Pins
RESYNC Edge
Result
Resulting RATE4[AB]
Resulting RATE3[AB]
CFG_IN4
CFG_IN5
4A
4B
3A
3B
Table 13 LOCKB, Output Technology for OUT3 and OUT4, and Odd Divider Configurations
Row
No.
Wiring of Configuration Pins
Output Interface Type
for OUT3 and OUT4
LOCKB
Odd DIvider
CFG_IN6
CFG_IN7
0GND
GND
LVPECL
Disable
3
1
GND
VDD
LVPECL
Disable
5
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