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参数资料
| 型号： | AD5384BBC-3 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 21/32页 |
| 文件大小： | 0K |
| 描述： | IC DAC 14BIT 40CH 3V 100-CSPBGA |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 产品变化通告： | AD5384 Models Discontinuation 15/May/2012 |
| 标准包装： | 1 |
| 设置时间： | 8µs |
| 位数： | 14 |
| 数据接口： | 串行 |
| 转换器数目： | 40 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 80mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LFBGA，CSPBGA |
| 供应商设备封装： | 100-CSBGA（10x10） |
| 包装： | 托盘 |
| 输出数目和类型： | 40 电压，单极 |
| 采样率（每秒）： | 125k |
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AD5384
Data Sheet
2-Byte Mode
Following initialization of 2-byte mode, the user can update
channels sequentially. The device address byte is required only
once, and the pointer byte is configured for auto-increment or burst
mode.
The user must begin with an address byte (R/W = 0), after which
the DAC acknowledges that it is prepared to receive data by pulling
SDA low. The address byte is followed by a specific pointer byte
(0xFF) that initiates the burst mode of operation. The address
pointer initializes to Channel 0, and upon receiving the two data
bytes for the present address, automatically increments to the next
address.
The REG0 and REG1 bits in the data byte determine which register
updates. In this mode, following initialization, only two data bytes
are required to update a channel. The channel address
automatically increments from Address 0. This mode allows
transmission of data to all channels in one block, and it reduces the
software overhead in configuring all channels. A stop condition at
any time exits this mode. Toggle mode is not supported in 2-byte
mode. Figure 29 shows a typical configuration.
1
0
1
0
1
AD1
AD0
R/W
0
A5 = 1
A4 = 1
A3 = 1
A2 = 1
A1 = 1
A0 = 1
START COND
BY MASTER
ADDRESS BYTE
POINTER BYTE
MOST SIGNIFICANT DATA BYTE
CHANNEL 0 DATA
LEAST SIGNIFICANT DATA BYTE
ACK BY
AD538x
MSB
ACK BY
AD538x
ACK BY
AD538x
ACK BY
AD538x
MOST SIGNIFICANT DATA BYTE
CHANNEL 1 DATA
LEAST SIGNIFICANT DATA BYTE
ACK BY
AD538x
ACK BY
CONVERTER
MOST SIGNIFICANT DATA BYTE
CHANNEL N DATA FOLLOWED BY STOP
LEAST SIGNIFICANT DATA BYTE
ACK BY
AD538x
ACK BY
CONVERTER
STOP
COND
BY
MASTER
REG1
REG0
MSB
LSB
MSB
LSB
REG1
REG0
MSB
LSB
MSB
LSB
REG1
REG0
MSB
LSB
MSB
LSB
SCL
SDA
SCL
SDA
SCL
SDA
SCL
SDA
04652-
031
Figure 29. 2-Byte, 12C Write Operation
Rev. B | Page 28 of 32
相关PDF资料 |
PDF描述 |
|---|---|
| AD5384BBC-3REEL7 | IC DAC 14BIT 40CH 3V 100-CSPBGA |
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| LTC1686IS8#PBF | IC TXRX RS485 PREC DELAY 8-SOIC |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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