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参数资料
型号： AD5384BBC-3
厂商： Analog Devices Inc
文件页数： 30/32页
文件大小： 0K
描述： IC DAC 14BIT 40CH 3V 100-CSPBGA
产品培训模块： Data Converter Fundamentals
DAC Architectures
产品变化通告： AD5384 Models Discontinuation 15/May/2012
标准包装： 1
设置时间： 8µs
位数： 14
数据接口： 串行
转换器数目： 40
电压电源： 单电源
功率耗散（最大）： 80mW
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 100-LFBGA，CSPBGA
供应商设备封装： 100-CSBGA（10x10）
包装： 托盘
输出数目和类型： 40 电压，单极
采样率（每秒）： 125k
Data Sheet
AD5384
TIMING CHARACTERISTICS
Serial Interface
DVDDx = 2.7 V to 5.5 V; AVDDx = 4.5 V to 5.5 V; AGNDx = DGND = 0 V; all specifications TMIN to TMAX, unless otherwise noted. The
AD5384 must remain powered up when part of a multidevice system with a common I2C bus. Guaranteed by design and characterization,
not production tested. All input signals are specified with tr = tf = 5 ns (10% to 90% of DVDDx) and are timed from a voltage level of 1.2 V.
See Figure 2, Figure 3, Figure 4, and Figure 5.
Table 3.
Parameter
Min
Typ
Max
Unit
Description
t1
33
ns
SCLK cycle time
t2
13
ns
SCLK high time
t3
13
ns
SCLK low time
t4
13
ns
SYNC falling edge to SCLK falling edge setup time
t51
13
ns
24th SCLK falling edge to SYNC falling edge
t61
33
ns
Minimum SYNC low time
t7
10
ns
Minimum SYNC high time
t7A
140
ns
Minimum SYNC high time in readback mode
t8
5
ns
Data setup time
t9
4.5
ns
Data hold time
t101
36
ns
24th SCLK falling edge to BUSY falling edge
t11
670
ns
BUSY pulse width low (single channel update)
t121
20
ns
24th SCLK falling edge to LDAC falling edge
t13
20
ns
LDAC pulse width low
t14
100
2000
ns
BUSY rising edge to DAC output response time
t15
0
ns
BUSY rising edge to LDAC falling edge
t16
100
ns
LDAC falling edge to DAC output response time
t17
3
s
DAC output settling time boost mode off
t18
20
ns
CLR pulse width low
t19
40
s
CLR pulse activation time
t202
30
ns
SCLK rising edge to SDO valid
t212
5
ns
SCLK falling edge to SYNC rising edge
t222
8
ns
SYNC rising edge to SCLK rising edge
t23
20
ns
SYNC rising edge to LDAC falling edge
1
Standalone mode only.
2
Daisy-chain mode only.
CL
50pF
TO OUTPUT PIN
VOH (MIN) OR
VOL (MAX)
200A
IOL
IOH
04652-
003
Figure 2. Load Circuit for Digital Output Timing
Rev. B | Page 7 of 32
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PDF描述
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