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参数资料
| 型号： | AD6657BBCZ |
| 厂商： | ANALOG DEVICES INC |
| 元件分类： | 无绳电话/电话 |
| 英文描述： | Quad IF Receiver; Package: Chip Scale BGA; No of Pins: 144; Temperature Range: Ind |
| 中文描述： | TELECOM, CELLULAR, RF AND BASEBAND CIRCUIT, PBGA144 |
| 封装： | 10 X 10 MM, 1.40 MM HEIGHT, ROHS COMPLIANT, MO-205AC, CSPBGA-144 |
| 文件页数： | 2/32页 |
| 文件大小： | 1021K |
| 代理商： | AD6657BBCZ |
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AD6657
Rev. A | Page 10 of 32
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
AGND
VIN+C
VIN–C
AGND
AVDD
CLK–
CLK+
AVDD
AGND
VIN–B
VIN+B
AGND
1234
5
6
78
9
10
11
12
AGND
VCMC
AGND
AVDD
AGND
VCMB
AGND
VIN+D
AGND
CSB
SDIO
SCLK
PDWN
SYNC
MODE
AGND
VIN+A
VIN–D
VCMD
AGND
AVDD
AGND
VCMA
VIN–A
AGND
AVDD
AGND
DRGND
DRVDD
D0–CD
D2–CD
D4–CD
D6–CD
D8–CD
D10–CD
D0–AB
D2–AB
D4–AB
D6–AB
D8–AB
D10–AB
D0+CD
K
D2+CD
D4+CD
D6+CD
D8+CD
D10+CD
D0+AB
D2+AB
D4+AB
D6+AB
D8+AB
D10+AB
D1–CD
D3–CD
D5–CD
D7–CD
D9–CD
DCO–CD D1–AB
D3–AB
D5–AB
D7–AB
D9–AB DCO–AB
D1+CD
A
B
C
D
E
F
G
H
J
L
M
D3+CD
D5+CD
D7+CD
D9+CD
DCO+CD D1+AB
D3+AB
D5+AB
D7+AB
D9+AB DCO+AB
08
55
7-
0
04
Figure 4. Pin Configuration (Top View)
Table 9. Pin Function Descriptions
Pin No.
Mnemonic
Type
Description
A5, A8, B5, B6, B7, B8,
D4, D5, D6, D7, D8,
D9, E2, E3, E4, E5, E6,
E7, E8, E9, E10, E11
AVDD
Supply
Analog Power Supply (1.8 V Nominal)
A1, A4, A9, A12, B1,
B2, B4, B9, B11, B12,
C2, C3, C10, C11, D3,
D10, E1, E12, F1, F2,
F3, F4, F5, F6, F7, F8,
F9, F10, F11, F12
AGND
Ground
Analog Ground
H1, H2, H3, H4, H5,
H6, H7, H8, H9, H10,
H11, H12
DRVDD
Supply
Digital Output Driver Supply (1.8 V Nominal)
G1, G2, G3, G4, G5,
G6, G7, G8, G9, G10,
G11, G12
DRGND
Ground
Digital Output Driver Ground
A7
CLK+
Input
ADC Clock Input—True
A6
CLK
Input
ADC Clock Input—Complement
C12
VIN+A
Input
Differential Analog Input Pin (+) for Channel A
D12
VINA
Input
Differential Analog Input Pin () for Channel A
D11
VCMA
Output
Common-Mode Level Bias Output for Analog Input Channel A
A11
VIN+B
Input
Differential Analog Input Pin (+) for Channel B
A10
VINB
Input
Differential Analog Input Pin () for Channel B
B10
VCMB
Output
Common-Mode Level Bias Output for Analog Input Channel B
A2
VIN+C
Input
Differential Analog Input Pin (+) for Channel C
A3
VINC
Input
Differential Analog Input Pin () for Channel C
B3
VCMC
Output
Common-Mode Level Bias Output for Analog Input Channel C
C1
VIN+D
Input
Differential Analog Input Pin (+) for Channel D
D1
VIND
Input
Differential Analog Input Pin () for Channel D
D2
VCMD
Output
Common-Mode Level Bias Output for Analog Input Channel D
K7
D0+AB
Output
Channel A and Channel B LVDS Output Data 0—True
J7
D0AB
Output
Channel A and Channel B LVDS Output Data 0—Complement
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