参数资料
型号: AD7949BCPZRL7
厂商: Analog Devices Inc
文件页数: 22/32页
文件大小: 0K
描述: IC ADC 14BIT 250KSPS 8CH 20LFCSP
产品培训模块: Power Line Monitoring
产品变化通告: Startup Circuitry Design Improvement Change 15/April/2009
标准包装: 1,500
系列: PulSAR®
位数: 14
采样率(每秒): 250k
数据接口: DSP,MICROWIRE?,QSPI?,串行,SPI?
转换器数目: 1
功率耗散(最大): 15.5mW
电压电源: 单电源
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 20-VFQFN 裸露焊盘,CSP
供应商设备封装: 20-LFCSP-VQ
包装: 带卷 (TR)
输入数目和类型: *
Data Sheet
AD7949
Rev. D | Page 29 of 32
UPDATE (n)
CFG/SDO
UPDATE (n + 1)
CFG/SDO
ACQUISITION (n)
ACQUISITION
(n - 1)
MSB
1
2
BEGIN DATA (n – 1)
BEGIN CFG (n + 1)
CFG
MSB
CFG
MSB – 1
12
13
SEE NOTE
NOTES
1. THE LSB IS FOR CONVERSION RESULTS OR THE CONFIGURATION REGISTER CFG (n – 1) IF
13 SCK FALLING EDGES = LSB OF CONVERSION RESULTS.
27 SCK FALLING EDGES = LSB OF CONFIGURATION REGISTER.
ON THE 14TH OR 28TH SCK FALLING EDGE, SDO IS DRIVEN TO HIGH IMPEDANCE.
14/
28
CONVERSION (n)
END DATA (n – 1)
END CFG (n + 1)
CFG
LSB
X
>
t
CONV
LSB
SCK
CNV
DIN
SDO
12
13
14/
28
CONVERSION (n – 1)
END DATA (n – 2)
END CFG (n)
CFG
LSB
X
t
CONV
t
DATA
t
CNVH
t
DATA
t
DIS
t
DIS
t
EN
t
DSDO
t
HSDO
t
HDIN
t
SDIN
t
CLSCK
t
EN
t
EN
t
SCK
t
SCKH
t
SCKL
t
DIS
t
DIS
t
CONV
LSB
t
ACQ
t
CYC
(QUIET
TIME)
(QUIET
TIME)
EOC
RETURN CNV HIGH
FOR NO BUSY
RETURN CNV HIGH
FOR NO BUSY
07351-
040
Figure 40. Serial Interface Timing for the AD7949 Without a Busy Indicator
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