参数资料
型号: AD9513BCPZ
厂商: Analog Devices Inc
文件页数: 11/28页
文件大小: 0K
描述: IC CLOCK DIST 3OUT PLL 32LFCSP
标准包装: 1
类型: 扇出缓冲器(分配),除法器
PLL:
输入: 时钟
输出: CMOS,LVDS
电路数: 1
比率 - 输入:输出: 1:3
差分 - 输入:输出: 是/是
频率 - 最大: 800MHz
除法器/乘法器: 是/无
电源电压: 3.135 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 32-VFQFN 裸露焊盘,CSP
供应商设备封装: 32-LFCSP-VQ(5x5)
包装: 托盘
产品目录页面: 776 (CN2011-ZH PDF)
配用: AD9513/PCBZ-ND - BOARD EVAL FOR AD9513
AD9513
Rev. 0 | Page 19 of 28
Table 11. Output Delay Full Scale
S0
Delay
0
Bypass
1/3
1.8 ns
2/3
6.0 ns
1
11.6 ns
Table 12. Output Logic Configuration
S1
S2
OUT0
OUT1
OUT2
0
OFF
LVDS
OFF
1/3
0
CMOS
OFF
2/3
0
LVDS
OFF
1
0
LVDS
CMOS
OFF
0
1/3
CMOS
1/3
LVDS
2/3
1/3
LVDS
CMOS
1
1/3
CMOS
LVDS
0
2/3
OFF
1/3
2/3
OFF
LVDS
2/3
OFF
CMOS
1
2/3
OFF
CMOS
OFF
0
1
LVDS
OFF
CMOS
1/3
1
CMOS
OFF
LVDS
2/3
1
LVDS
OFF
LVDS
1
CMOS
OFF
CMOS
Table 13. OUT2 Delay or Phase
S3
S4
OUT2
Delay
(S0 ≠ 0)
OUT2
Phase
(S0 = 0)
0
1/3
0
1/16
1
2/3
0
1/8
2
1
0
3/16
3
0
1/3
1/4
4
1/3
5/16
5
2/3
1/3
3/8
6
1
1/3
7/16
7
0
2/3
1/2
8
1/3
2/3
9/16
9
2/3
5/8
10
1
2/3
11/16
11
0
1
3/4
12
1/3
1
13/16
13
2/3
1
7/8
14
1
15/16
15
Table 14. OUT2 Divide or OUT1 Phase
S5
S6
OUT2
Divide (Duty Cycle1)
(S2 ≠ 0)
OUT1
Phase
(S2 = 0)
0
1
0
1/3
0
2 (50%)
1
2/3
0
3 (33%)
2
1
0
4 (50%)
3
0
1/3
5 (40%)
4
1/3
6 (50%)
5
2/3
1/3
8 (50%)
6
1
1/3
9 (44%)
7
0
2/3
10 (50%)
8
1/3
2/3
12 (50%)
9
2/3
15 (47%)
10
1
2/3
16 (50%)
11
0
1
18 (50%)
12
1/3
1
24 (50%)
13
2/3
1
30 (50%)
14
1
32 (50%)
15
1 Duty cycle is the clock signal high time divided by the total period.
Table 15. OUT1 Divide or OUT2 Phase
S7
S8
OUT1
Divide (Duty Cycle1)
(S2 ≠ 1)
OUT2 Phase
(S2 = 1 and S0 ≠ 0)
0
1
0
1/3
0
2 (50%)
1
2/3
0
3 (33%)
2
1
0
4 (50%)
3
0
1/3
5 (40%)
4
1/3
6 (50%)
5
2/3
1/3
8 (50%)
6
1
1/3
9 (44%)
7
0
2/3
10 (50%)
8
1/3
2/3
12 (50%)
9
2/3
15 (47%)
10
1
2/3
16 (50%)
11
0
1
18 (50%)
12
1/3
1
24 (50%)
13
2/3
1
30 (50%)
14
1
32 (50%)
15
1 Duty cycle is the clock signal high time divided by the total period.
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